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例说FPGA连载95:基于HDMI的AV采集显示之功能概述

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例说FPGA连载95:基于HDMIAV采集显示之功能概述

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         本实例系统功能框图如图19.1所示。以NIOS II处理器为主构建一个基本的嵌入式系统。IIC控制器外设为自定义组件,通过Avalon-MM总线连接到NIOS II处理器,NIOS II处理通过对IIC控制器的访问实现HDMI控制器芯片ADV7513的初始化配置;HDMI_MODE_PIO组件连接到HDMI显示驱动模块,NIOS II处理器可以通过该模块实现在线的HDMI驱动时钟和分辨率的动态切换。逻辑部分实现AV视频信号的解码、时域变换、去隔行处理、视频流缓存以及HDMI显示驱动。本实例只有一路AV视频输入,但是在HDMI显示器上,我们将这一路分辨率为640*480AV视频图像进行复制,在分辨率为1280*960HDMI显示器上显示出4个完全一样的AV视频图像,即所谓的“一拖四”。

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19.1 工程实例17功能框图

 

 

 

 


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