HDL 其他相关软件
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发表于 2010/8/13 15:30:38
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Visual IP
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可以为IP core供源代码保护和用户仿真模型 | |
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| QuartusII与Mathlab的接口，利用IP核在Mathlab中快速完成数字信号处理的仿真和最终FPGA实现 | ||
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| Synplicity公司最新推出的一种验证工具，可以在FPGA工作时查看实际的节点信号，甚至可以像调试单片机一样，在HDL代码中设断点 | ||
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Synplify DSP
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和DSP Builder ,System Generator 类似,用于数字信号处理的开发 | |
| 一个很好用的HDL设计工具，能够自动将子模块聚合成一个顶层文件。 免费共享软件 |
