异步复位，同步释放
为了保证信号的稳定性，对于复位信号应该同步化，这个思想在工程项目中应该注意。如下就是特权做的处理，但是对于这个处理我的疑问是：复位信号的第二次处理，即PLL输出后的处理，为什么只用了一个时钟对复位信号的处理，而另外的时钟为什么不
发表于 8/20/2013 3:55:47 PM
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RGB与YUV
RGB和YUV都是色彩空间，用于表示颜色，两者可以相互转化。YUV（亦称YCrCb）是被欧洲电视系统所采用的一种颜色编码方法（属于PAL）。YUV主要用于优化彩色视频信号的传输，使其向后兼容老式黑白电视。与RGB视频信号传输相比，它最大的优点在于只
发表于 8/19/2013 4:49:34 PM
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VGA
一说到VGA，我们马上就想到了电脑的显示器，它不就是VGA吗，我当初也是这么想的，但是后来看到的资料却显示VGA还是一种分辨率，我当初就想VGA接口怎么就变成了分辨率呢，于是我就找了一些相关资料，这下明白了，其实VGA不仅表示一种分辨率，还是VGA接口。下
发表于 8/19/2013 4:12:02 PM
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组合逻辑和时序逻辑分开写
由于前阵子去忙别的事了，所以OV7670摄像头的研究就进行到一半就终止了，这几天恰好有时间就接着研究研究。研究中发现一个很奇特的现象组合逻辑和时序逻辑分开写，组合变化迅速，但是最终不影响时序逻辑的结果。如下图明显组合逻辑OV7670_DATA_REG_N只要always@(*)内输
发表于 9/1/2012 5:21:33 PM
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学习FPGA的心得（转）
转载：http://blog.chinaaet.com/detail/6589.html回想起自己学FPGA，已经有一段时间了，从开始的茫然，到后来的疯狂看书，设计开发板，调电路，练习各种FPGA实例，到最后能独立完成项目，一路走来，感受颇多，拿出来和大家分享，顺便介绍下自己的一点经验所得，希望对
发表于 6/7/2012 4:16:53 PM
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verilog 可综合语句 总结
（1）所有综合工具都支持的结构：always，assign，begin，end，case，wire，tri，aupply0，supply1，reg，integer，default，for，function，and，nand，or，nor，xor，xnor，buf，not，bufif0，bufif1，notif0，notif1，if，inout，input，instantitation，module，neg
发表于 6/7/2012 3:41:51 PM
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设置 SignalTap II 文件的基本流程
设置SignalTapII文件的基本流程1．设置采样时钟。采样时钟决定了显示信号波形的分辨率，它的频率要大于被测信号的最高频率，否则无法正确反映被测信号波形的变化。SignalTapII在时钟上升沿将被测信号存储到缓存。2．设置被测信号。可以使用NodeFinder中的SignalTa
发表于 6/7/2012 3:34:47 PM
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阻塞与非阻塞的区别
做了一个PWM的简单模块，无意中让我发现了阻塞与非阻塞的他们的区别真的很大，一不小心真的会让人找不到错误在哪里。。。。。下面我贴出我的分析：非阻塞：always@(posedgeCLOCK)if(!REST_N)beginF<=0;j<=
发表于 6/4/2012 4:19:40 PM
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马克思教我们优化时序之补全if else
看完这篇maybeomustbe的这篇博客觉得if，else却是很神奇，在此保留。转载：http://blog.chinaaet.com/detail/27865.html时序优化中重要的一项就是提高模块的最高工作频率，工作频率由关键路径决定，通常的提高工作频率的步骤是：利用时序分析工具找到关键路径，分
发表于 6/4/2012 7:12:43 AM
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Quartus II的常见错误分析
Error:Top-leveldesignentity"XXX"isundefinedErr顶层实体没有定义！最好把你的工程名和实体名（module后面的名字）设为同一个即可，刚入门的时候，都有这样的经历。菜单Assignments->Settings...打开后点击第一个General选项里，在Top-levelentity
发表于 5/31/2012 4:26:01 PM
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示波器常见几个错误
转载：http://blog.chinaaet.com/detail/27752.html觉得以后有用，现在暂且保留
发表于 5/28/2012 5:47:59 PM
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TimeQuest必看资料
转载：http://blog.chinaaet.com/detail/22590.html1.Riple-TimeQuest一定要搞定此处我已整理为PDF档。2.Altera–TimeQuestCookbookhttp://www.altera.com/literature/manual/mnl_timequest_cookbook.pdf3.Altera-时序分析的胶片，
发表于 5/21/2012 3:12:48 PM
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关于verify failed的总结
1.SDRAM的时序不对，有时候不正确的pllclockphaseshiftforsdram_clk_out就会导致SDRAM不能正常工作（我的就是这个问题，希望大家注意，困扰我好几天。。。。。）2.SDRAM的连线不对,物理板子的连线问题3.在调试的时候,程序下载的空间不是非易丢失存储器（non-volatilemem
发表于 5/4/2012 10:30:05 AM
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ILI9320 一些事儿
这两天一直在研究ILI9320，当初也迷糊过，也头疼过，但是静下心来，自己看看datasheet，看看网上别人的曾经，慢慢的，慢慢的也就明白了，哈哈，下面是我的总结：TFT彩色液晶驱动心得【控制器ILI9320】一、坐标原点位置的确定首先，买回来的液晶屏，有一个位置，就
发表于 4/27/2012 3:05:17 PM
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三段式状态机的思维陷阱
转载：http://blog.chinaaet.com/detail/26661.html用三段式描述状态机的好处，国内外各位大牛都已经说的很多了，大致可归为以下三点：1.将组合逻辑和时序逻辑分开，利于综合器分析优化和程序维护;2.更符合设计的思维习惯;3.代码少，比一段式状态机更简洁。对于第一点，
发表于 4/21/2012 9:42:36 AM
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