Can’t configure device. Expected JTAG ID code问题总结
今天改写一个工程，结果下载时出现了Error:Can’tconfiguredevice.ExpectedJTAGIDcode0x020830DDfordevice1,butfoundJTAGIDcode0x020840DD.上网搜了下搜到了一下内容：1：JTAG下载不稳定（1）用ByteBlasterMV[LPT1]下载线下载*.sof文件时，下载到87%就会出现下面的
发表于 11/24/2010 8:34:07 PM
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SOPC自定义组件AVALON 总线命名规则
1modulemy_multiport_component(2//SignalsforAvalon-MMslaveport“s1″3avs_s1_clk,4avs_s1_reset_n,5avs_s1_address,6avs_s1_read,7avs_s1_write,8avs_s1_writ
发表于 8/18/2010 5:22:51 PM
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HDL语言常见综合指令
black_box_pad_pin声明用户定义的黑盒的管脚，作为外部环境可见的I/Opad，如果有不止一个端口，列在双引号内，以逗号分开。一般不需要这一属性，Synplify提供了预定义的I/Os。其语法如下object/*synthesissyn_black_boxblack_box_pad_pin="port_list"*/;例如
发表于 8/18/2010 11:39:45 AM
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用AX88180和FPGA实现千兆网——更高速度的实现
哥发现自己错了，AX88180技术文档中给出的最高发送速度是100MHz，所以哥的PLL是2/1分50MHz的，刚才抽筋想是否可以用125MHz试试，结果点开PLL的向导，发现里面哥的分频怎么是3/2啊，明明在BDF里显示的是2/1吗，不信邪点开.v文件，一看果真是3/2分频的，也就是以上的速度
发表于 8/17/2010 10:18:59 AM
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关于Error: Can't compile duplicate declarations of entity "**" into library "work"的错误
发表于 8/13/2010 11:39:35 AM
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关于在quartus II中如何连接总线和模块引脚
今天用亚峰的SEG7模块，因为他写的模块不是针对我所使用的开发板，所以输出并不匹配，他的板子是用74LS138译码器，我的板子是没有译码直接输出的，虽然我可以改他的模块，但是嫌麻烦，就想直接利用quatusII自有的74138模块进行转换。转换图如下：注意：1.要通过net（网
发表于 8/12/2010 5:22:26 PM
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