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FPGA学习一~~数码管动态显示
说明一下我用的是Actel的A3PO30板晶振是48M的程序解释得很详细首先是分频的模块moduleclk_div(clk,//时钟输入，48Mreset,//异步复位
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逻辑分析仪我也DIY（四）—神秘蓝点
今晚把各个显示的字符都DIY上去了，不过在某些蓝色字符附近出现了许多意外的神秘蓝点，如下：上面一共四个Ch字符中，只有Ch2是完全没有问题的，特权同学就感觉很纳闷了，为什么同样的16个Ch字符，就这几个出现这
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逻辑分析仪我也DIY（三）—PLL后复位问题
关于M4K的问题还没有结束。主要问题在于想利用M4K来存储要显示到VGA屏幕上的字模数据，而昨天为了方便开了一个很大位宽的M4K，结果就照成了M4K的利用率大大下降，原来不到8K的数据居然占用了7个M4K块，感觉不爽。所以今天绞尽脑汁是想出了解决办法，同时也为其他字符的
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逻辑分析仪我也DIY（二）
昨晚睡觉时还寻思着为什么数据采集显示出来怎么问题多多，明明全低电平居然时不时的采集到高电平，后来想想也是，两块板子（被采集信号产生板子和模拟逻辑分析仪的板子）没有共地，采集到的电平高低没有一个参考点，判断错误也就在所难免了。于是今晚共地后，多次
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MOSFET驱动电路的设计—重编
我以前写过MOS管寄生参数的影响和其驱动电路要点写的比较匆忙，里面错误较多，这段时间潜心修改，整理一部分希望大家能看看。PS：我自己写文章，好像太没有美感了，到处都是1，2，3，4；不过我现在还没想好，是否还有比这种序号层次更清晰的叙事方式，前后300页+附录到
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数字信号控制器的增强型事件管理器
基于德州仪器(TI)F24xTM与F28xTM数字信号处理器(DSP)的控制器事件管理器模块在DSP中采用可编程逻辑形式，以生成脉宽调制(PWM)信号，并主要满足三相系统的设计要求；不过，由于具有一定灵活性，因此在添加一些软件之后也可以轻松用于具有更多相位或特殊要求的应用。事件
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请教TI DSP的ePWM如何强制管脚状态？
在2812使用EV的时候可以直接写EVx.ACTRx直接控制PWM输出的强制高、强制低，在使用ePWM的器件上应该怎么配置，从而可以强制高、强制低呢EPwm1Regs.AQSFRC.bit.OTSFA=1;EPwm1Regs.AQSFRC.bit.ACTSFA=1;EPwm1Regs.AQSFRC.bit.OTSFB=1;EPwm1Regs.AQSFRC.bit.ACTSFB=1;请问这
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modelsim用不了原来有这问题
装了modelsim之后每次运行都是license，试了各种方法都不行。后来才发现，竟然是modelsim和solidworks冲突，把solidworks的东西删除干净就好了。
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[笔记].使用Protues仿真Max7129.[C][Keil][Proteus]
引子在NiosII上调了好几天的I2C，PCF8563都没有被正常驱动，很是伤感。干脆先用51驱动试试。首先要解决的便是显示问题，用Max7129来驱动七段数码管。仿真环境硬件部分：Proteus7.5SP3软件部分：KeiluVision4Proteus仿真图图1Proteus仿真图Keil工程lay:inline;border-top
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[笔记].I2C札记.[I2C]
数据的有效性SDA数据线必须在SCL时钟线的高电平周期保持稳定，在SCL时钟线的低电平周期才可改变高低电平。图1I2C总线的位传输起始和停止条件起始条件（S）：SCL时钟线保持高电平时，SDA数据线从高电平向低电平切换；停止条件（P）：SCL时钟线保持高电平时，SDA数
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[原创].HAL的不同方式访问字符器件的空间开销简单比较.[C][Nios II]
注：本文所述皆为查询方式的比对，中断方式下请读者自习研究比对。范例：/dev/jtag_uartUnix类型图1系统库属性设置源代码：01#include"system.h"02#include"fcntl.h"03#include"unistd.h"0405intmain(void)06{07intfd;
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[笔记].sizeof()和strlen()的区别.[C]
sizeof()源代码：1#include<stdio.h>2intmain(void)3{4charmsg[]="HelloNios!";5printf("sizeof(msg)=%ld",sizeof(msg));6return0;7}运行结果：sizeof(msg)=
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