新书印刷好了，希望大家喜欢
发表于 9/30/2015 11:18:50 AM
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新书马上又要出版了欢迎大家捧场啊
出版社提供了两款封面让我选择，个人有很强烈的选择恐惧症，我抓阄选了第二个黄色的，不知道大家更喜欢哪个版本？！非常感谢大家的支持，由于新书还在编辑之中，在征得出版社的同意后，这里我先把原版未编辑过的目录放出来，大家可以先大致了解这本书的内容，欢迎大家多
发表于 5/11/2015 10:59:01 AM
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【无线】所见即所得之Stratix和Cyclone架构EDA及学术开发功能描述
Stratix和Cyclone架构EDA及学术开发功能描述1．概述本文是Stratix和Cyclone器件架构中各种所见即所得原语用户手册的部分内容。本文为设计者可以或者更详细的细节，确保在设计布线的时候能够更容易让设计布通。使得设计
发表于 3/13/2014 4:59:03 PM
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【无线】所见即所得StratixII之EDA及学术开发功能描述
1．概述同Stratix/Cyclone。2．逻辑单元（LogicCell）描述在以前的架构中（比如Cyclone），单个LE包括一个组合逻辑和寄存器。对于StratixII来说，组合逻辑和寄存器被单独分开到两个部分，原语创建的时候也不象Cyclone和Stratix那样，而是通过lcell_comb（组合逻辑部分）
发表于 3/13/2014 4:57:21 PM
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【无线】CycloneII之EDA及学术开发功能描述
1．概述同Stratix/Cyclone。2．逻辑单元（LogicCell）描述在以前的架构中（比如Cyclone），单个LE包括一个组合逻辑和寄存器。对于CycloneII来说，组合逻辑和寄存器被单独分开到两个部分，原语创建的时候也不象Cyclone
发表于 3/13/2014 4:52:45 PM
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《深入理解ALTERA FPGA设计》新书已上架
亚马逊地址：http://www.amazon.cn/%E5%8D%9A%E5%AE%A2%E8%97%8F%E7%BB%8F%E9%98%81%E4%B8%9B%E4%B9%A6-%E6%B7%B1%E5%85%A5%E7%90%86%E8%A7%A3Altera-FPGA%E5%BA%94%E7%94%A8%E8%AE%BE%E8%AE%A1-%E7%8E%8B%E6%95%8F%E5%BF%97/dp/B00HTWPPH0/ref=sr_1_1?ie=UTF8&am
发表于 1/21/2014 9:31:33 AM
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《深入理解Altera FPGA 应用设计》新鲜出炉啦
发表于 1/13/2014 4:18:34 PM
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【最牛B电工】新书封面新鲜出炉
发表于 12/27/2013 1:42:25 PM
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新书《深入理解Altera FPGA 应用设计》出版倒计时
内容简介本书结合作者多年工作实践，以开发流程为主线，通过大量实例详细介绍了FPGA开发、调试方面的一些基本方法和独特技巧；提出了一种“自动化”开发设计的理念，即通过批处理加脚本的方式自动完成FPGA设计工程的建立、编译和转移，以
发表于 12/24/2013 2:53:07 PM
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【技术分享】FPGA复位电路的实现及其时序分析
FPGA复位电路的实现及其时序分析概述大部分的FPGA和ASIC设计都是基于大量flip-flop或者寄存器的同步系统设计，所以所有这些同步单元的起始状态或者将要返回的状态是一个已知状态（罗辑‘1’或者‘0’）就显得非常重要
发表于 12/24/2013 9:51:11 AM
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[原创博文] 有计划写一本关于ALTERA FPGA开发设计提高方面的书
计划写一本关于Altera器件开发设计方面的书，整理了一个目录，希望大家多给一些建议和意见！！！ALTERAFPGA设计提高第一章好好准备你的FPGA设计1.1FPGA设计要求“软硬兼施”吗1.2如何帮助项目选择一个合适的FPGA1.3教你如何从顶层规划你的设计1.4进行早期功
发表于 5/28/2013 3:53:08 PM
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【再说FPGA】ECO那些事之属性编辑器
ECO那些事之属性编辑器王敏志概述进行ECOs有两种方法，一种是直接在ChipPlanner里进行，另外一种是在属性编辑器里进行ECOs。本文试图结合笔者在TDC设计中使用的功能尽量详细地描述一下属性编辑器，毕竟属性编辑器可以
发表于 3/22/2013 3:55:56 PM
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【再说FPGA】设计和仿真6.25G速率下的ALTERA器件StratixII GX
设计和仿真6.25G速率下的ALTERA器件StratixIIGX王敏志概述点对点的高速设计可以利用ALTERA的GXB之Basic模式来实现，ALTERA给出了这种模式下6.25G速率下参考实例。本文基于StratixIIGX器件介绍GXB设计和仿真，特别需要
发表于 3/15/2013 11:25:07 AM
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【再说FPGA】PLL那些事之core输出抖动
PLL那些事之core输出抖动王敏志概述这里的PLL是指ALTERA的FPGA内部的PLL，PLL的输出有两种，一种是coreoutput，另外一种是externaloutput，由于ALTERA只给出了PLL的输出到外部引脚的jitter，并没有给出PLL的core
发表于 3/9/2013 1:01:41 PM
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【再说FPGA】TimeQuest之Multicycle Paths
TimeQuest之multicyclepaths王敏志概述Multicyclepaths即多周期路径，指的是两个寄存器之间数据要经过多个时钟才能稳定的路径，一般出现于组合逻辑较大的那些路径。在实际工程中，除了乘除法器等少数比较特殊的电路，一般应该尽量
发表于 3/4/2013 11:33:42 AM
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