【再说FPGA】uart数据收发控制器结构设计
前几天写了UART的收发控制器，能够正确地发送和接收数据，但是用于实际应用还差很远，最主要的是数据输入端需要发送的数据你必须配合UART的波特率时钟送入才行，否则会丢失数据，解决这个问题的方法是在发送端和接收端都加一个FIFO
发表于 1/4/2013 12:29:38 AM
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UART串口收发控制器
UART调试记录：UART协议看起来很简单，但是里面涉及好几个小细节，处理起来也不是那么轻松顺畅的，代码写完，调试过了再想起来来也确实就那么回事。重要的是掌握解决问题的方法，代码贴在这里，备忘备参考备修改。异步通信协议这是
发表于 12/27/2012 9:47:43 PM
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典型的状态机设计实例
Note:Allofflowingarefromwebsiteofaltera//4-StateMealystatemachine//AMealymachinehasoutputsthatdependonboththestateand//theinputs.Whentheinputschange,theoutputsareupdated//immediately,withoutwaitingforaclockedge.Theoutputs//canbewrittenmorethanonceper
发表于 12/17/2012 1:56:55 PM
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