signal-TapII使用教程
我们知道FPGA的设计需要借助仿真工具，但是有时候介于仿真速度较慢。一个优秀的testbench又比较难写，因此我们在这里高效的使用signal-TapII对我们的设计能够起到事半功倍的效果。下面简单的介绍一下signal-Tap的用法...
发表于 2016/4/13 14:58:41
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关于modelsim-altera使用路径的修改
不知道是我的电脑有问题还是怎么回事，我觉得我使用网上选择modelsim-altera的路径和网上一致的时候总是不能驱动modelsim，但是我讲路径改成如下的方式便能使用~~大家如果不能解决可以试试我得路径。C:\altera\1...
发表于 2016/4/13 14:14:45
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一幅图弄清DFT与DTFT,DFS的关系
很多同学学习了数字信号处理之后，被里面的几个名词搞的晕头转向，比如DFT，DTFT，DFS，FFT，FT,FS等，FT和FS属于信号与系统课程的内容，是对连续时间信号的处理，这里就不过多讨论，只解释一下前四者的关系。首先说明一下，我不是数字信号处理专家，因此这里只站在学生
发表于 2015/7/25 11:01:09
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2015电子设计大赛之分频电路移相电路
最近因为考研的事情和期末考试的事情实在的太忙了，博客也好久没有更新了，这不前几天参加我校的电子设计大赛，我们这次做的是李萨如发生装置，这边需要用到移相和分频电路，这边我都是通过FPGA完成的，由于网上的分频电路和移向电路没有
发表于 2015/6/26 19:49:56
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FPGA 初学者征程（8) 基本组合电路之编码器
今天我们先来介绍二进制编码器，我们知道二进制编码器分为两种类型，二进制普通编码器和二进制优先编码器，先来介绍一下二进制普通编码器，我们先来看看二进制普通编码器的真值表：有了真值表我们就可以写代码了，我们的代码
发表于 2015/5/2 20:33:50
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FPGA 初学者征程（8) 基本组合电路之比较器
好了，今天我们来说是比较器，比较器的真值表如下图所示：闲话少说，直接看代码/*modulename：compare.v；modulefunction：compareAandB；Author：nicemancontact：18921428564@163.comweibo:niceman1992version:v1.0writedate:2015/4/18
发表于 2015/4/25 21:25:25
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FPGA 初学者征程（7) 基本组合电路之加法器
首先声明一下，前几篇博文老是图片不能看，估计是因为我直接在原来我的新浪博客上复制过导致图片无法查看，因为实在太忙，大家如果有意看的话，前几篇请点击这个链接就OK了：http://blog.sina.com.cn/u/320947在上一篇博文中我说到了我的models
发表于 2015/4/24 13:25:35
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求助，modelsim仿真时候自动退出
昨晚做modelsim的仿真实验，原来是采用的modelsim-Altera，在全quartus-II中调用，以前都是可以的，但是这次在文件编译结束以后modelsim自动关闭。现在采用se，直接用do文件区仿真发现还是闪退，也是在编译结束之后闪退，大神能否帮忙解决问题？？？不胜感激
发表于 2015/4/23 12:54:57
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FPGA 初学者征程（6) modelsim altera 仿真
这么多天么没有写个人博客了，考研的确实辛苦，今天上了一整天的高数课，闲来无事，我们接着来。从前面的几篇博文中，我们学会了CPLD的简单的一些例程，包括LED和按键，这些属于比较简单的的。对单片机比较了解的朋友也许用过仿真器。作为一个合格的程序猿
发表于 2015/4/18 21:06:50
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FPGA 初学者征程（5）按键检测
原来的工程都是只有输出而没有输入，这次我们说大点来个人机交互，哈哈，好了，不吹了，我们今天学习按键的检测。学过单片机的小伙伴们都知道按键是我们对整个工程控制的接口。好了，我们先来看看按键的接口电路。&nbs
发表于 2015/4/18 21:05:42
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FPGA 初学者征程（4）流水灯
上次简单的一个例子简单的介绍了利用quartusII软件开发FPGA的整个流程，从本节起我们将逐渐的学习一些驱动，为了引起大家的兴趣，我们先学习可以看到现象的历程，在这结束之后，对于后面的博文我将会持续更新有关仿真的一些东西和代码调试的一
发表于 2015/4/18 21:04:39
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FPGA 初学者征程（3）开发流程
工欲善其事，必先利其器。下面我们就搭建FPGA的开发环境，开始我们的FPGA的开发之旅。我们知道FPGA是硬件，和学习单片机一下，这样的东西需要反复练习才能掌握，因此我希望在你的面前能有一块FPGA开发板，如果你的layout的能力比较强，您完全可以自己
发表于 2015/4/18 21:03:29
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FPGA 初学者征程（2）verilog 语法简介
各位朋友大家好，现在我们开始我们的第二篇征程；对ＦＰＧＡ稍微有点了解的朋友们都知道FPGＡ的开发语言目前主流的有两种，verilog和VHDL这两种硬件描述语言，现在systemverilog也是工程师开发FPGA的主流语言，由于本人限于时间原因，没有学习过systemverilog这里
发表于 2015/4/18 21:02:39
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FPGA 初学者征程（1）可编程器件简介
自己学习FPＧＡ也将近一年多了，一年对于我这样的菜鸟来说也总是觉得要写点什么，这下面一系列的博文都是给初学者介绍的，还请各路大神指正，希望对于以后愿意学习ＦＰＧＡ的小伙伴给予一点点帮助，也算给自己的一些总结，我们一起共同进步。由于本人大三，现在忙
发表于 2015/4/18 21:01:36
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出现的问题
今天在做视频处理，将视频的RBG转换成YUV格式，然后对Y分量进行中值滤波，最后进行sobel边缘检测，原本都是写好的模块，移植之后发现ＶＧＡ显示的是一片白，调试了好久均没有出现结果，后来思索的的过程中，想到在模块的例化过程中原来出现了一个没有将连线用ｗｉｒｅ声
发表于 2015/4/18 21:00:37
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