Lattice Radiant 加密RTL设计文件简明教程
Lattice Radiant软件是Lattice近年来新推出的FPGA开发平台，主要针对的是2019以后发布的新器件。之前我转载过一篇关于如何使用Diamond中的Synplify Pro产生NGO文件（黑匣子）来加密用户RTL设计文件的...
发表于 2021/1/7 10:44:01
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Synplify Pro的RTL视图与Technology视图以及优化分析
在进行Verilog/VHDL Coding的时候，很多人喜欢先通过检查设计的RTL视图是否符合预期，然后在通过功能仿真和时序仿真来验证设计的功能正确性。
以Lattice Diamond/Radiant 开发工具中集成的Synplify Pro为例，用户可以在弹出的Synplify Pro的界面中的HDL-Analyst->RTL打开RTL视图（综合完成之后）。
发表于 2020/1/8 15:00:32
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Lattice Diamond Reveal SerDes Debug Core简明教程（For ECP5）
本文将以Lattice ECP5为例，简要地介绍一下如何使用Diamond中的Reveal工具来调试SerDes/PCS。文中使用的Project在文章最后的附件中，Project是基于Lattice ECP5 Versa板写的，可以直接使用。
发表于 2019/6/18 17:56:25
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Lattice Diamond EPIC工具使用简明教程（一）
由于部分复杂IP中包含了PLL等基础的Module，用户在调用（例化）这些复杂的IP时，一般不可以直接去修改其中包含的Module的配置参数，这些配置参数是由IP工具自动产生的。但是，在某些特殊的情况下，用户可能对IP工具自动产生的配置参数...
发表于 2018/9/5 14:29:59
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Lattice Diamond的PMI原语使用简明教程
PMI (Parameterized Module Instantiation) ，即参数模块实例化，是一种便捷的例化Lattice标准Module的方式。从功能实现角度来说，PMI能够实现的，IPexpress（或者Clarity）都能够实现；从使用的角度来说，例化PMI模块，和我们平时例化其他的模块，几乎没有任何区别。
发表于 2018/1/19 9:40:10
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一个关于Diamond中的Reveal如何选用参考时钟的问题
最近在调试DDR3的时候遇到一个奇怪的问题，经过一段时间的排查定位，最后发现是Reveal引起的，下面来简单地总结一下。
发表于 2018/1/9 9:40:39
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Diamond使用Clarity生成的IP插入Reveal后无法综合的解决方案
问题描述：
某个工程里面使用了Clarity生成的IP，并直接将Clarity生成的sbx文件导入到工程中。在未使用Reveal功能之前，一切正常。但是当插入Reveal功能时，发现此时使用Synplify Pro综合和报错，说IP的某个文件重复了（而实际上并没有重复），因此综合失败。因为这些文件是必须的，所以解决方式肯定不是删除这些文件。
发表于 2017/12/19 11:21:09
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Diamond无法完成PAR的解决方案
当RTL逻辑较为复杂时，尤其是使用了多个EBR和MULT时，采用Diamond默认的Strategy时，有的时候会无法成功的PAR（P and R， Place and Route），或者PAR的速度特别慢。这个时候，我们可以尝试修改Strategy来解决这一问题。
发表于 2017/12/18 9:04:35
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利用TCL脚本（do文件）管理仿真流程简明教程（一）ActiveHDL RTL仿真篇
如本篇博文的标题所示，今天要聊的是高级一点的内容：利用TCL脚本（do文件）管理ActiveHDL RTL仿真流程。标题中的（一）表示，后续可能还会继续发布关于ActiveHDL 另外两种仿真流程的TCL脚本控制方法以及Modelsim软件的相关内容。
发表于 2017/8/16 14:52:41
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Diamond中调用ActiveHDL仿真入门教程
1、新建my_testbench.v文件，并输入如下内容；2、Tools->SimulationWizad；3、
发表于 2017/7/4 21:55:50
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Diamond中，设置第三方文本编辑器（如notepad++）教程
Diamond中自带的源码编辑器并不是特别好用，我们可以自己设置自己习惯使用的第三方文本编辑器作为Diamond默认的源码编辑器。具体的步骤如下：1、
发表于 2017/7/4 21:32:24
阅读（3052）
Diamond中的IPexpress入门教程
IPexpress是Lattice官方提供，集成与Diamond中的一些IP核，可以通过简单的配置以生成VerilogHDL或者VHDL的代码，以供用户实例化（调用）。一些芯片中的功能推荐使用（甚至只能使用）IPexpress来生成代码，比...
发表于 2017/7/4 21:22:13
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