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vivado中通过AXI配置可调时钟输出
项目需要：实现一个可调的时钟，来探测实验对象的速率边界。范围1mhz-50mhz。现在时钟的产生一般都是PLL(Phase Locked Loop)实现的。锁相环通常由鉴相器（PD）、环路滤波器（LF）和压控振荡器（VCO）三部分组成。模拟...
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片式电感器是什么 片式电感器有哪些类型
片式电感器也是电感器的一种类型，也被成为表面贴装电感器，大家在日常生活中是否有使用过片式电感器呢？片式电感器又有哪些产品类型呢？跟着正芯网（现货IC采购平台）去了解一下吧。片式电感器与其它片式元器件（SMC及SMD）一样，是适用于表面贴装技...
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【读书笔记】详细解析基于三段式状态机的流水灯
【主题】：详细解析基于三段式状态机的流水灯【作者】：LinCoding【时间】：2016.11.16 对于学习Verilog的同学来说，状态机并不陌生，状态机分为一段式、两段式和三段式，具体优缺点请大家百度。网上一大把，本文笔者...
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【读书笔记】详细解析74HC595驱动程序
【主题】：详细解析74HC595驱动程序【作者】：LinCoding【时间】：2016.11.15 首先感谢好友送了一本特权同学新出的《例说FPGA》，因为最近有事情，不知道什么时候会开始看，这一段时间把之前CB书上的代码做...
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采用Darlington管驱动Relay
什么场合需要Relay在一些过电流的电路中，采用coil吸附簧片的机械式relay有内阻低和耐压高的优势。这些都是IC型模拟开关不具备的。以常用omron的G6K板上relay举例，内阻 100 mΩ max，过流 1 A at 30 VD...
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Vivado中综合实现和出bit文件
接上一节的把IP搭建成原理图，这节说下综合实现和出bit文件。各Block都搭建完成后，选中这个bd右键，Generate Output Products主要是把IP参数和连接信息update到project中，同时也会检查错误。（一般sy...
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Vivado中新建工程或把IP搭建成原理图
上一节说了怎么建自己的IP，下面把自己的设计方案用IP的方式搭建成原理图。新建project选择芯片型号xc7z020clg400-1既然vivado是按照IP原理图来设计的，首先是要添加block直接从IP Catalog中选择想要的IP...
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厚膜集成电路,什么是厚膜集成电路
厚膜集成电路,什么是厚膜集成电路用丝网印刷和烧结等厚膜工艺在同一基片上制作无源网络，并在其上组装分立的半导体器件芯片或单片集成电路或微型元件，再外加封装而成的混合集成电路。厚膜混合集成电路是一种微型电子功能部件。1.特点和应用与薄膜混合集成...
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Vivado中将verilog代码封装成IP
Xilinx的Vivado采用原理图的设计方式，比较直观适合大型项目，我们自己的code都需要封装成user IP。这里主要介绍怎么把多个关联管脚合并成类似bus的大端口第一大部分 选择source文件先新建一个project，把要pack...
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【新火山的硬件】电源完整性设计的重要意义
做了那么多年的硬件，也画了N多的PCB，从一开始的将线连好就可以的菜鸟，到后来知道了有信号完整性的初入门者，再到后来，逐渐积累了更多高速PCB设计的知识和技巧。什么PCB板材和信号的关系啊，叠成设计的合理性啊，阻抗匹配啊，信号完整性啊，到后...
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I2C转GPIO的IO扩展芯片输出电流不足-PCF8574
板子上因为IO口不够用，采用了一个I2C转8路GPIO的芯片PCF8574（tssop20），控制Darlington管MC1413，驱动后端的7个Relay。控制逻辑简图：问题：调试中发现，前面的控制逻辑都是正确的，但是Darlingto...
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电容式称重传感器的三个缺点
称重传感器是一种将质量信号转变为可测量的电信号输出的装置。电容式称重传感器利用电容器振荡电路的振荡频率f与极板间距d 的正比例关系工作。极板有两块，一块固定不动，另一块可移动。在承重台加载被测物时，两极板之间的距离发生变化，电路的振荡频率也...
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转 Linux 软件安装到 /usr，/usr/local/ 还是 /opt 目录？
Linux 的软件安装目录是也是有讲究的，理解这一点，在对系统管理是有益的/usr：系统级的目录，可以理解为C:/Windows/，/usr/lib理解为C:/Windows/System32。/usr/local：用户级的程序目录，可以理...
