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My thought about study

突然发现一个很有趣的现象,就是关于“难”的这个话题。因为在最近的生活学习中我遇到了一些挫折,然后就觉得这个课真难啊!然后就觉得没必要全部的科目都学好云云之类的。现在觉得真的是不可理喻,因为我对这个觉得难的这个科目确实没有花多少时间在上面,只是当我看这
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功能安全之“元器件失效模式”

正文:继续王顾左右而言他。因为功能安全是在是很大的一个概念。如果说细了,篇幅很长,显得无趣;而且会显得虚,可操作性差。因为,工程师往往要求的不是knowwhat、knowwhy,而是knowhow。&n
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图解流程VS2010添加MSCOMM控件

图解流程VS2010添加MSCOMM控件时间就是金钱,好多东西我脑子里实现了,真正画出来只能靠他人给我去执行。。这两天就一妹子在VS2010下通过MSCOMM控件写了一个激光雷达控制的软件。。结果今天这妹子出去快活去了。。工程给我。。我打不开。。、。崩溃的如下:网上查了些资
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可变参数函数的出入栈顺序

今天在一个论坛上,看到printf的题,就做了一下。后来做错了。。看了看解析。是有关printf()这种可变参数的函数的出入栈的顺序。。入栈是从右往左。。出栈是从左往右。。inta=0,b=0;printf("%d,%d,%d",a++,++b,a+b);入栈操作先执行a+b。。在执行++b,最后执行a++出栈先执
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浅谈基于FPGA的直方图均衡化

本文声明,根据牛人博客,总结描述的。。。http://blog.chinaaet.com/detail/37431http://blog.chinaaet.com/detail/37437直方图均衡化处理的“中心思想”是把原始图像的灰度直方图从比较集中
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W5500中断寄存器的理解

中断部分,W5500中文手册V1.0写的不够清楚,该文是本人结合中英文手册及自己理解,整理出有关中断部分的理解,如有不正确的请指正。一:引脚INTn为中断输出(Interruptoutput)低电平:W5500的中断生效;高电平:无中断或者处于中断生效等待中二:中断相关
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intel+altera de2i-150开发板

DE2i-150是一个开创性的嵌入式平台,将AlteraCycloneIVGXFPGA的灵活性整合进了英特尔嵌入式N2600处理器。它是一套功能齐全的计算机系统,采用了全球最保险的高处理性能和难以置信的高配置。DE2i-150板上的AlteraCycloneIVGXFPGA不但加快了系统的响应速度,
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用数码管和定时器做的时钟

呵呵,感谢刘老师的讲解,终于做出来了,没有白费2个小时的时间。感觉比较难的是时钟的算法。继续努力。第4个程序:用数码管和定时器做的时钟。标记的都是重点#include<reg52.h>typedefunsignedcharuchar;typedefunsignedintuint;sbitdua
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数码管动态显示

第3个程序:数码管动态显示。继续努力#include<reg52.h>typedefunsignedcharuchar;typedefunsignedintuint;sbitduan=P1^7;sbitwei=P1^6;voidDelayMS(uintz){uint&nbs
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数码管静态显示

第二个程序:数码管静态显示0-9继续努力#include<reg52.h>typedefunsignedcharuchar;sbitwei=P1^6;sbitduan=P1^7;ucharcodetab[]={0X3F,0x06,0X5B,0X4F,0X66,0X6D,0X7D,0X07,0X7F,0X6F};uchari=0;//定义i为全局变量,目的是为了在中断程
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细细讲述以DSP为核心的嵌入式系统

很多都听过嵌入式系统,尤其是学习电子技术的人,最为常见的就是以dsp开发板为核心的嵌入式系统。从数字技术和信息技术的角度看,嵌入式系统已成为现代信息网络技术应用的基础技术,已成为现代工控领域的基本技术。使用嵌入式系统技术,不仅可以实现
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Hauntbox:用于控制你的自动化、电子创意家居的开源硬件盒子

Hauntbox是一个开源硬件控制器,可以满足用任意传感器和控制器建立复杂的、自动化的萦绕在心头的电子项目。它不需要焊接或者预先学什么知识,是完全可控制、并与Arduino插板兼容。无需编程,就用开源支持控制器,让你出没的地方及项目轻松加入声音,并实现自动化
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parameter localparam `define的使用

parameterlocalparam`define的使用——两忘而化其道(fei199311)昨天在看代码时,遇见了localparam这个参数定义的关键字,感觉不是太懂,所以就查了查,今天彬哥的书,发现他的书上也写了关于这三个参数定义的内容(P366),就这个内容写一个总结吧。Verilog中可以用关
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见程序如见人---没有代码风格还学什么FPGA

人人都知道文如其人,这里的“文”对程序员来说指的就是代码,从一段代码源文件能看出很多问题,比如:1)此人所在公司版本管理是否规范,是否有统一的代码风格。如果一个公司没有统一的代码规范,则一个大的项目基本无法维护,无法继承,往往代码的编写者离职后,继承者
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cordic算法的verilog实现

利用quartusII13.0例化了一个ALTFP_SINCOS可是仿真出来的结果就是不对啊结果是32'b0和{31'b0,1'b1}这是为什么呢?我输入无论是固定值还是计数器的值都是这个样子,咋回事呢?去官方论坛也有此问题的网友,手册介绍的也不够详细啊!关键是结果只有32'b0和{31'b0,1'b1},