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Vivado Logic Analyzer的使用
chipscope中，通常有两种方法设置需要捕获的信号。1.添加cdc文件，然后在网表中寻找并添加信号2.添加ICON、ILA和VIO的IPCore第一种方法，代码的修改量小，适当的保留设计的层级和网线名，图形化界面便于找到需要捕获的信号。第二种方法，对代码的改动
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Vivado HLS何去何从？——近日的一些尝试
Vivado HLS何去何从？ ——近日的一些尝试 如何更好的利用vivado hls是我近期一直在思考的问题。是不是一般的c程序都能很好的转换为IP核？应用的限制在哪里？hls更适合用来做什么？ 带着这些疑问，做了...
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Vivado HLS图像拼接系统原理及实现
从工业检测系统到自动驾驶系统，计算机视觉是一个包括许多有趣应用的广泛领域。许多这样的系统在原型和实现阶段都要用到开源计算机视觉(OpenSourceComputerVisionLibrary，OpenCV)。OpenCV优化了许多功能函数，并在实时的计算机视觉程序中得到应用。但是，由于嵌入式优
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VGA显示中不同分辨率时行场信号的区别
最近在弄VGA的显示有关试验，然后用示波器观察不同的分辨率下的行场信号的波形，发现不同的分辨率的波形是不同的。假如把行场信号看作脉冲信号，观察窄脉冲的方向的变化（宽度的变化要测量，测量了部分，有误差）。&nb
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高斯模糊 方程改进方案
高斯模糊（英语：GaussianBlur），也叫高斯平滑，是在AdobePhotoshop、GIMP以及Paint.NET等图像处理软件中广泛使用的处理效果，通常用它来减少图像噪声以及降低细节层次。在上一篇博客中，为了计算权重，我们得到图像二维的高斯函
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【原创】Thread网络协议-让家庭互联更简单
最近看到飞思卡尔又搞了一个新的东西，thread，小小研究一下。Thread是一种基于简化版IPv6的网状网络协议，该协议由行业领先的多家技术公司联合开发，旨在实现家庭中各种产品间的互联，以及与互联网和云的连接。Thread易于安装、高度安全，并且可扩展到数百台设备。Thre
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高斯模糊
高斯模糊（英语：GaussianBlur），也叫高斯平滑，是在AdobePhotoshop、GIMP以及Paint.NET等图像处理软件中广泛使用的处理效果，通常用它来减少图像噪声以及降低细节层次。1简介高斯模糊（GaussianBlur）是美国Adobe图像软件公司开
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在Vivado下进行功耗估计和优化——高亚军
作者：高亚军资源、速度和功耗是FPGA设计中的三大关键因素。随着工艺水平的发展和系统性能的提升，低功耗成为一些产品的目标之一。功耗也随之受到越来越多的系统工程师和FPGA工程师的关注。Xilinx新一代开发工具Vivado针对功耗方面有一套完备的方法和策略，本文将介绍如
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低端电子产品的灵魂——音叉晶振
在电子信息技术快速发展的年代,不管期望与现实之间的产据有多少,总是能够产生意想不到的效果.在2012年下半年所发布的苹果iPhone5的确有一次掀起了全球智能手机终端产品的高潮.但是人们都知道,现在电子产品的更新换代是如何之迅猛,短短两年时间
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IC设计流程与使用工具介绍
《ic设计流程与使用工具介绍》我认为IC设计流程按照功能和应用场合不同大致可以划分为三个部分进行介绍，分别是数字IC、模拟IC和FPGA。这三者之间既有相同点又有相异点。在进行设计时，所使用的软件工具也有相同和不同的。1).数字A
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RFID频段
RFID頻段分為低頻、高頻、超高頻、微波等四個頻段，其中目前以高頻及超高頻(860～960MHz)及微波為主要應用。低頻(LF):125～135KHz高頻(HF)：13.56MHz超高頻(UHF)：433MHz及860～960MHz微波(Microwave)：2.45GHz各頻段之特性比較頻率低頻(LF)高頻(HF)
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[原创]基于Vivado的C程序设计原理
最近利用Vivado进行了几个C程序的设计，取得一点小小心得，与大家分享。众所周知，C程序一个重要内容就是main（），main（）函数下面的程序都会被合成分析，在Vivado中被合成的程序称为顶级程序或者设计文件，任意在其中函数称为测试台，测试台用于确定被合成的顶级程序
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在Vivado下利用Tcl编辑综合后的网表——高亚军
作者：高亚军在ISE下，对综合后的网表进行编辑几乎是不可能的事情，但在Vivado下成为可能。Vivado对Tcl的支持，使得Tcl脚本在FPGA设计中有了用武之地。本文通过一个实例演示如何在Vivado下利用Tcl脚本对综合后的网表进行编辑。Vivado支持传统的Tcl命令，在此基础上添加
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开源 《单片机那些事儿》（连载）为初学而生 第9章 中断篇
具体内容大家一看图就知道了，内容，大家只能下载，慢慢看了。单片机那些事儿（中级篇）——第9章中断.pdf
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启动HardCopy系列器件设计
采用HardCopy®ASIC规划的系统实现了真正的硬件和软件协同设计，大大缩短了系统面市时间，使您能够尽快获得收益。Altera的Quartus®II软件工具使用简单，结合Altera及其合作伙伴的知识产权(IP)，帮助你同时进行FPGA和ASIC设计。只要在QuartusII软
