《Verilog HDL 综合实用教程》读书笔记——阻塞与非阻塞(补充)
组合逻辑用阻塞式赋值，时序逻辑用非阻塞式赋值（当对变量的赋值和引用都在同一条always中时，可以采用阻塞式）。阻塞赋值的组合逻辑：regTM,TN,TO,TZ;a
发表于 7/22/2010 7:42:43 PM
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Spartan-3A (2007-02-06 23:22:54)
听了eeplace的关于Spartan-3A的研讨会。总结如下：Spartan-3A的特点是IO资源丰富，增强的IO性能；1.2V的内核电压，3.3V的端口电压；电源管理；从用一个PROM可对FPGA进行不同的配置（MultiBoot）；每个芯片内部有独一无二的57位DNA，等等。传统的FPGA内部逻辑资源和IO是
发表于 7/21/2010 1:42:00 PM
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FPGA重配置过程中各生成文件略解(2007-01-30 21:19:37)
发表于 7/20/2010 9:12:09 PM
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FPGA功耗——XPower (2006-11-24 09:37:05)
所查资料：《FPGA/CPLD设计工具——XilinxISE使用详解》P309功耗仿真器XPower（ISE中代的工具）是第一个用于可编程逻辑器件的功耗分析软件，可以分析FPGA和CPLD的整体以及特定网线的功耗。进行功耗分析时，XPower可以读
发表于 7/19/2010 4:07:52 PM
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MicroBlaze (2006-11-02 11:16:06)
eeplace网上研讨会时间：11月1日10:00-12:30网址：http://www.eeplace.com/eeplace/eventDetail.ecp?lang=cn&action=DETAIL&eventid=1368主题：通过使用32位软处理器(MicroBlaze)快速启动您的嵌入式设计主讲：Xilinx亚太区高端产品市场经理梁晓明先生获取知识：
发表于 7/19/2010 4:07:09 PM
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readback 笔记（5）(2006-10-26 01:38:03)
修改state寄存器中GSR值的方法。在工程中添加startup_spartan2（一种特殊资源），startup_spartan2有GSR的输入引脚，置1是reset/set。原本是想，如果GSR不reset，任务就可以在状态bitstream的基础上继续执行。这样就有个问题，控制GSR不reset是
发表于 7/17/2010 10:47:29 PM
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readback 笔记（4）(2006-10-21 02:38:49)转载
readback后任务执行的状态可被回读回来，但是如果将回读的bit流不加修改的写回到FPGA中，任务并不是从回读时的状态开始执行，而是又从初始态开始执行，也就是说状态bit对配置没影响（回读到的与初值不同的状态是FF的writebit）。xilinx的文档中没有说
发表于 7/17/2010 10:46:54 PM
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