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什么时候需要交换Top Level ?
什么时候需要交换Top Level ? 上一篇中提到，如果采用仿真的时候，运用门级仿真就需要进行顶层交换，RTL仿真不需要，那么什么时候需要呢？ QuartusII 向下包含，在Project Navigator中可以查看...
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为什么使用LUT比GAL 节省资源
为什么使用LUT比GAL 节省资源A[1:0] B[1:0] 实现一个比较器，如果A=B输出1 否则输出0传统的GAL 需要 24= 16个存储单元（ROM）来存储结果数据，实现方法是 缓冲器（正负）+译码器 + 或门A[7:...
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QuartusII中调用Modelsim的方法
Modelsim的使用1， 建立工程编译通过之后——证明实例工程无语法等简单错误。编写testbench2， 将testbench 添加到工程中，进行编译通过。会在工程的file中看到testbench也在工程file中——证明test...
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记北邮创新展
第一次去北邮参观创新展。没想到，竟是如此惊喜。近150种创新实践成果，同学们活跃的气氛，瞬间让你感受到创客应有的狂热状态。为了让你最快了解到展览的内容，先将关键字排开一列。物联网、智能家居、智能农业、智能医疗、机器人、开源硬件、语音、Arduino、ARM
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【红色飓风Nano二代测评】插补绘图之钢炼纹章
上次通过按键画一些横平竖直的线，感觉不太爽。这次想通过插补（而不是按键）画一些有趣的图形。画些什么呢，我的思绪一下飘到了大学时代，在那个暑假，白天和大家在实验室备战电子竞赛，晚上就会回到寝室和达子一起看钢炼，回忆起那段时间，真是充实而美好。好吧，这次
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持续进阶之三数码管简易时钟显示
先上代码，持续更新，望大侠见谅，不要嫌弃小弟哦,望大侠高手多多指点小弟，多给小弟提提意见与建议/*MCU：STC89C52RCFosc:11059200Hz日期：2014-04-28网名：坎悟积验功能：简单的数码管时钟显示：00-00-00:hour-fend-miao*/#include<reg52.h>typedefunsignedchar
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关于一段verilog代码的思考
前段时间有人在网上问以下一段代码，代表什么意思。always@（posedgeclk）beginif(rst_n)din<=0;elsebegindin<=din+1’b1;if(en)din<=a–1’b1;end初看这段代码，发现这里的din有两次进行
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Makeblock搬运遥控车之SONY PS2手柄
图1SONYPS2手柄遥控Makeblock搬运遥控车全景图先用LabVIEW可视化界面，确定出Arduino编程时所需的参数。这些参数包含有搬运车夹持器爪子张合角度；直线导轨上夹持器的升降高度和速度；以及小车走直线时的左右电机PWM值。这篇文章就要谈谈如何用SONYPS2手柄
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Altera在Arria 10中率先集成硬核浮点DSP模块，新一代产品初露锋芒！
4月23日，Altera向京城媒体宣布正在发售的Arria10FPGA集成了符合IEEE754的硬核浮点DSP模块，其FPGA浮点DSP性能方面在业界率先实现了变革。未来，该硬核浮点DSP模块技术也将集成在14nmStratix10FPGA和SoC中。采用硬核浮点DSP模块究竟能带来什么好处呢？让我们听听A
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苹果最受瞩目的14笔收购
1.语音助手开发商Siri基于语音的数字个人助手开发商Siri成立于2007年。苹果于2010年4月将其收归门下，具体收购金额不详。该公司后在2011年将Siri语音助手引入iPhone4S，作为iOS移动操作系统的一部分。2.音乐制作软件商Emagic2002年7月，苹果收购了来自德国的Emagic，收
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进入第2步数码管动态刷新显示01234567
先上代码，高手勿喷记录我学习的点滴过程，完成用定时中断动态刷新数码管显示01234567，方法有点笨望请原谅/*MCU：STC89C52RCFosc:11059200Hz2014-04-27坎悟积验*/#include<reg52.h>typedefunsignedcharUint8;typedefunsignedintUint16;typedefunsignedlongUint32
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基于FPGA的SPI串口之二
SPI的另一个Verilog程序，此设计，加入fifo用以缓存发送或接收数据，同时，master与slave的transferregister通过mosi和miso相连，形成环路，此设计更符合SPI协议wfempty-->发送fifo空信号bit&nbs
