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VS低版本打开高版本相关技巧/设置（不适用于6.0）

曾经在本科的时候学过MFC，后来一直没用，给忘差不多了。同时由于VerilogHDL的根深蒂固，让我写C，写完if，下一句直接变成了begin，。。。。并行的思维已经占据了我的海马体，写串行很吃力。。。不过最近由于一个东西得改，各种求人有劲使不出来，最后各种请教，还是自

CrazyBingo

发表于 3/27/2014 10:54:42 AM

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夏宇闻老师谈FPGA工程师的入门学习

1.必须清楚自己究竟适合不适合做工程师。看看自己的性格特点，是不是特别安静，又耐得住寂寞。因为FPGA工程师是一个辛苦的工作，不但要通过不断学习研究提升自己的设计水平，还要经常性的熬夜加班敲写代码，如果没有一种耐得住寂寞的性格，你最好不要去做FPGA工程师。因

he li

发表于 3/27/2014 10:28:49 AM

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inout仿真终极方案

仿真inout确实是个麻烦事，同一个端口，既要写TestBeach输入激励信号，又要观察输出的响应信号。但是往往，就看到了自己的输入激励，而看不到响应信号，今天就通过一个例子，提出一个简单的仿真方案。首先，建模部分如下：1:moduleinout_test2:

宋桓公

发表于 3/27/2014 10:03:44 AM

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【原创】飞思卡尔KL系列低功耗特性和唤醒时间测试

上篇内容提到了在低功耗应用中需要考量的三个技术指标，在上篇中说了说低功耗模式的唤醒源问题，那本篇内容则重点对另外两个技术指标即低功耗电流和唤醒时间进行了简单的测试，验证是否与官方数据手册中的数据一致，毕竟还是自己测出来心理才踏实嘛，

jicheng0622

发表于 3/27/2014 2:37:52 AM

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【原创】分享飞思卡尔KL25使用UART通信唤醒低功耗模式代码

飞思卡尔基于ARMCortex-M0+内核的KinetisL系列的低功耗特性被广泛使用在可穿戴设备、智能水电气表类及移动手持设备等等需要电池供电的对功耗敏感的应用领域。而我们在低功耗应用过程中，通常来说主要会考量三个重要的指标，即低功耗模式下的最低电流

jicheng0622

发表于 3/27/2014 1:42:47 AM

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电路原理图/电路图/PCB板设计

本人可提供原理图和pcb板子

xinliangsf

发表于 3/26/2014 10:09:27 PM

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FPGA的LCD显示菜单

硬件结构：FPGA(AlteraEP4CE10)+字库芯片（GT21）+LCD显示芯片（st7565，128X32）输入端口：按键（4个）+SPI接口（与DSP通信）LE资源：总共10000逻辑单元（LE），其他功能模块占去4500LE，剩余皆用于LCD显示LCD基本驱动参考《Verilog_HDL_那些事儿》，较为详细，可读性

qjfun

发表于 3/26/2014 7:58:09 PM

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