Modelsim时序仿真中遇到的三个问题
我很少做时序仿真（记忆中针对8051的IPcore做过QuartusII下面的时序仿真，针对Samsung的一款NandFlash仿真模型做过Modelsim下的时序仿真）。一是因为仿真速度慢；二是因为仿真的对象是布局布线后的门级网表，许多信号都消失不见了。由于其受限的可观察性，针对布局后网
发表于 4/30/2010 11:00:01 AM
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采用Signal Spy增强VHDL的测试能力
可观测性和可控制性是对testbench的基本要求。与Verilog相比，VHDL语言缺少层次化路径访问的能力；但是在VHDL语言中可以通过全局变量进行entity之间的通讯，这里的全局变量就是在package中定义的signal。在实际应用中，Verilog的层次化路径访问是真正的“无损探测&
发表于 4/28/2010 3:00:42 PM
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采用JobSpy控制Modelsim批处理仿真
JobSpy可以用来管理Modelsim的批处理仿真过程，具体应用如下：1.Checkingtheprogressofasimulation.2.Examininginternalsignalvaluestocheckifthedesignisfunctioningcorrectly,withoutstoppingthesimulation.3.Suspendingonejobtoreleasealicenseforamoreimportantjob,
发表于 4/28/2010 2:58:37 PM
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构思中的
发表于 4/28/2010 2:46:10 PM
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学习Modelsim的命令（一）
发表于 4/28/2010 2:41:36 PM
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Modelsim中，结合使用Project和.do的最佳方法
发表于 4/28/2010 1:42:07 PM
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Modelsim下如何做代码覆盖率分析
发表于 4/28/2010 11:40:23 AM
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Modelsim仿真脚本与批处理运行模式
发表于 4/28/2010 11:30:48 AM
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