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晶振

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[视频].Altera eTraining:SignalTap II 逻辑分析仪的使用.[SignalTap]

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Xilinx FPGA 教程lab3的一些补充,并回答沈阳的刘先生的提问

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All about my course named Introduction to EDA

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英格兰大败,该死的信“人眼”

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How to Be a Good Graduate Student(3)

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How to Be a Good Graduate Student(2)

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《基于FPGA的快速系统原型开发》CH3.2译

3.2FPGA设计流程高层次的FPGA设计流程包含了需求分析、结构设计、实现以及验证。在需求分析阶段,定义并完善高层次的需求,这一阶段的任务是完成系统功能的说明。下一阶段是结构设计阶段,这一阶段进行厂商、器件型号和开发工具的选择,也是对设计团
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《ModelSim SE Command Reference》笔记1

《ModelSimSECommandReference》命令:.mainclear说明:“.mainclear”命令清除清除脚本。该行为如同:File>Transcript>ClearTranscriptmenu。命令:.wave.treeinterrupt说明:该命令将停止wave窗口的波形绘制,对于终止一个需要很长时间显
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[视频].Altera eTraining:使用Nios II处理器.[Nios II]

引子以前看的时候,就觉得蛮好;近日再仔细看,收获依然颇丰。特推荐给大家一起看看。AlteraeTraining使用NiosII处理器目的
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关于AVR熔丝位的设置

使用ISP串行方式下载编程时,应配置SPIEN熔丝位为“0”
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关于AVR中断的疑问

今天在用AVR的时候试了一下中断嵌套感觉很怪我的两个中断服务程序如下我在中断程序里面都用了SEI();用JTAG调试了一下发现只要TCNT0一溢出就触发TIMER0的中断在中断的过程中只要TCNT2一溢出就触发了TIMER2的中断
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How to Be a Good Graduate Student(1)

-----------------------Page1-----------------------HowtoBeaGoodGraduateStudentMariedesJardinsmarie@erg.sri.comAbstractThispaperattemptstoraisesomeissuesthatareimportantforgraduatestudentstobesuccessfulandtogetasmuchoutoftheprocessaspossible,andforadv
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学习编程技术的22个重点

1.不要看到别人的回复,第一句话就说:给个代码吧!你应该想想为什么。当你自己想出来再参考别人的提示,你就知道自己和别人思路的差异。2.初学者请不要看太多的书那会误人子弟的。先找一本好书系统的学习。很多人用了很久都是只对部分功能熟悉而已,不系统
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[笔记].怎样使用Debussy+ModelSim快速查看前仿真波形.[Debussy][ModelSim][Verilog]

引子:ModelSim是HDL仿真软件,Debussy是波形查看软件;搭配使用,相当爽。此处所谓快速查看前仿真波形仅为抛砖引玉,大家不要拘泥于此。两款软件的功能都很强大,请自行研究。注:本篇博文的软件环境为:Debussy5.3v9+ModelsimSE6.5配置篇1安装、和谐软件。略。2