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STM32正交编码器驱动电机
1。编码器原理什么是正交？如果两个信号相位相差90度，则这两个信号称为正交。由于两个信号相差90度，因此可以根据两个信号哪个先哪个后来判断方向。这里使用了TI12模式，例如当T1上升沿，T2在低电平时；T1下降沿，T2在高电平时，
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根文件系统制作
一.建立根文件系统目录与文件1.创建目录*mkdir/home/ARM11/kernel/rootfs*cd/home/ARM11/kernel/rootfs*mkd
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QP-nano结构分析
QP-nano是QP的一个裁剪版本，是一个通用的、可移植的、超轻量级的事件驱动型框架。适用于像8051、PIC、AVR、MSP430、68HC01/11/12、R8C/Tiny等资源受限的8位和16位MCU。其一个QP-nano应用可以放入到只有100字节的RAM和2K字节ROM的系统中。适用的应用范围是电机控制，照
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ARM2440 LCD实验
1.S3C2440内部LCD控制器结构图：我们根据数据手册来描述一下这个集成在S3C2440内部的LCD控制器：a：LCD控制器由REGBANK、LCDCDMA、TIMEGEN、VIDPRCS寄存器组成；b：REGBANK由17个可编程的寄存器组和一块256*16的调色板内存组成，它们用来配置LCD控制器的；c：LCDCDMA是
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uboot 1.1.6 在 MINI2440 上的 NorFlash移植
开发环境：目标板：mini2440uboot版本:u-boot-1.1.6交叉编译工具:rm-linux-gcc-4.4.3通过查阅S29AL016的datasheet以及mini2440开发板原理图可知:a.这是SPANSION公司的一个2Mx8-Bit/1Mx16-Bit
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zynq驱动程序
zynq模块裸机驱动程序目录：Xilinx\SDK\2015.2\data\embeddedsw\XilinxProcessorIPLib\driverszynq DDR3逻辑端有4个HP接口可以控制，评估效果可以参考xapp792Refe...
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3、关于边沿检测简单理解一
1、所谓边沿检测，就是检测输入信号或FPGA内部逻辑信号电平的跳变，即实现上升沿或下降沿的检测，捕获到以后以此用作使能信号（简单可理解为：一旦检测到这个信号，则发生什么什么），来作为时序逻辑的触发信号。总之，在基础中，这个还是很重要的，在后...
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嵌入式开发平台 三星A9 4418开发板 独家支持2G内存
iTOP-4418开发板预装 Android4.4.4 系统， 支持9.7 寸、7 寸、4.3 寸屏幕，操作流畅；4418完美兼容八核6818处理器，独家提供1GB和2GB内存版本，核心板支持电池管理，充放电电路与电量计，板载千兆以太网，3...
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FPGA开发工具汇总
下面是我平时收集到的一些开发工具，整合一下，希望能给需要的人带来帮助。如果连接失效了，可以评论告诉我一声，我看到了会及时更新Quartues II 13.1 链接：http://pan.baidu.com/s/1pKBfNN9 密码：8uv...
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2、FPGA学习之模式LED
模式LED灯，设置了三个按键，每次按下一个按键后，LED灯呈现对应的状态。一个左移，一个右移，一个当前状态翻转。module key_led( clk, rst_n, key, led); input clk; ...
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xilinx管脚分配
1.DDR3使用1.5V电平或者1.35V电平，如果DDR3 bank剩下管脚需要用做LVDS管脚，不能使用内部100欧姆电阻，需要外挂电阻才能用做LVDS差分对；
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xilinx 功耗分析
环境温度高，漏电流大，功耗升高；两片16位DQS DDR3，功耗大概600mW（SSTL电平标准），如果信号质量较好，可以使用功耗较低的SSTL-R电平接口，功耗大概500mW
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常见约束分析
单端时钟画在了CC pin的N端引脚set_property CLOCK_DEDICATED_ROUTE FALSE [get_nets HDMIR0_CLK_IBUF]
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fpga中latch
一直都知道fpga中有latch这么一回事，但是一直都不太清楚到底什么是锁存器，它是怎么产生的，它到底和寄存器有多少区别，它怎么消除。为什么说他不好？ 一 什么是latch 锁存器是一种在异步时序电路系统...
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【原创】MT9P001内部PLL的启动
MT9P001是镁光公司生产的一款CMOS摄像头。它具有500万像素，可以通过IIC接口对摄像头的寄存器进行配置，从而实现增益、曝光时间、帧率和分辨率可调。今天要介绍的是如何启动MT9P001内部的PLL，从而实现渴望的像素时钟频率。通过查...
