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MDO4000混合域示波器结构解密（中）
MDO优于传统频谱仪对于MDO4000混合域示波器上的RF专用通道，第一个值得注意的是它所提供的频谱捕获带宽。从以上关于传统扫频式频谱仪到矢量信号分析仪的描述中我们知道它们所能提供的频谱捕获带宽都比较窄，一般在10MHz范围左右，最昂贵的、最好的也只提供大约150
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力控科技工博会载誉归来，未来之路任重道远！
关键词：力控,监控组态软件,工业博览会,ForceControl,实时数据库,pSpace,煤矿,石油天然气,能源管理2012年11月6日—11月10日第十四届中国国际工业博览会在中国上海新国际博览中心隆重召开。此次会议以“创新转型与战略性新兴产业”为主题，办展宗旨紧紧围
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如何通过VPN连接到网络
VPN联网视频教程，让你不再为翻墙困惑。--------------------------------------WIZnet专注全硬件TCP/IP协议栈，能卸载MCU的内存负担，让其网络接入更加稳定、高效！详情登陆我们的官方博客：blog.iwiznet.cn官方网站：www.iwiznet.cn&nb
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【赛灵思FPGA】赛灵思发布基于20nm的第二代3D IC和SoC产品策略
9月，Altera公司资深副总裁兼首席技术官博思卓(MishaBurich)博士来京，公开了Altera在下一代20nm的的几项创新技术。（见博客：http://blog.chinaaet.com/detail/29761.html）笔者一直在疑惑，其最大竞争对手Xilinx在20nm又将如何动作呢？上周五(11月9日)，Xilinx全球高
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【原创】尝鲜Kinetis L系列之MKL25初探
前几天老师扔过来一块儿清华做的MKL25Z的最小系统板让我做下测试，我嘿嘿一笑，本来就对KinetisL系列觊觎已久了（前段时间还写了一篇关于KinetisL的介绍，传说中的超高能效32位MCU）可惜手上一直没有板子，结果这么快就“天上掉下了个粘豆包”，
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【转】Qsys在系统集成中的应用
1.1摘要在FPGA设计中可能涉及到集成系统的设计，Altera为这种设计提供了方便的SOPC集成系统，现在又推出了更为先进的Qsys系统，当这种转变提出后，也去尝试使用过Qsys系统，并未发现优势在哪里，无非是界面改变了，一些系统总线需要自己连接了，都是
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基于全硬件TCP/IP的产品应用实例
——WIZnet员工Alex培训笔记今天Jerry给我培训WIZnet产品应用相关的知识，我做了个简单的总结，同大家分享一下我的学习经验，下面也提到一些产品的应用实例，大家都可以参考下，也给我一些你们的建议。喜欢我这篇文章的朋友一定要记得给我留言噢~解决完
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【原创】没硬件怎么玩zynq7000?
手头还没ZYNQ7000的板子，模拟个环境玩玩吧，该博文首发于个人主站：http://gnssinfo.com没硬件怎么玩zynq7000?xilinx官网提供了QEMU，可以在前期没有硬件的情况下也可以了解zynq7000，关于QEMU的详细介绍请参考：http://wiki.xilinx.com/zynq-qemu当然，这里仅指的是玩
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硬件协议栈那点事儿 （续集）
上一次我们同事写了一篇名叫“硬件协议栈那点事儿”的文章，受到很多朋友的欢迎，这次我延续它的主心骨，换一个不同的思路，给大家讲讲看我理解中的全硬件tcp/ip。——WIZnet员工Alex培训笔记培训一开始，首先Jerry帮我解决了上次培训中我还
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吉时利SCPI 2700系列指令执行内建极限测试
2700系列和3700系列仪器具有与两组极限相同的内建极限功能。Limit1和Limit2使用高极限和低极限（HI1和LO1以及HI2和LO2）。此状态指示适用于首次失效的极限，即便两个极限都失效了。虽然Limit不是全局参数，当配置为简单扫描时，极值和状态都适用于扫描的全
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MSP430-UART异步串口
硬件介绍：MSP单片机的USART模块可以配置成SPI（同步通信）模式或UART（异步通信）模式，这里只讨论UART方式。UART数据传输格式如下：起始位，数据位由高到低7/8位，地址位0/1位，奇偶校验位奇偶或无，停止位1/2位。数据位位数、地址位、奇偶校验位、停止位均可由单片机
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串口转以太网模块—WIZ100SR 用户手册(三)
上次给大家介绍了WIZ100SR的一些内容，今天我接着介绍WIZ100SR用户手册的最后一部分关于硬件配置、引脚图和演示测试的内容。希望对大家有所帮助。…4.2.用串行命令配置WIZ100SR图16.串口配置使能设置①检查WIZ100SR固件版本。如果版本较低，从http://www.iw
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【赛灵思FPGA】DSP in FPGA：FIR滤波器FPGA实现结构——脉动型
这节主要讲解脉动型(Systolic)FIR滤波器设计。脉动型FIR滤波器是对直接型的升级，在每个操作后都加入流水线级，每个动作都打一拍，就跟心脏跳动一样，因此称为脉动型
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【原创】最新版Jlink驱动不能随便用了！——Segger开始正视Jlink盗版问题
哎，混混噩噩的这样过了好长一段时间，最近效率低下的很，干什么都没有以前那股子劲头了，大概是每年应届毕业生的通病吧。“女怕嫁错郎，男怕入错行”，找工作真的是件让人心烦却又不得不去严肃正视的活儿，在面对决定今后走向的时候，我们不得不
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【赛灵思FPGA】[原创]基于Xilinx FPGA的μC/OS-II的串行驱动应用
看天气越来越冷了，创作的激情可不能冷却。今天主要演示一下使用串行口0用中断方式来发送和接受数据。UART0原理框图如下：UART0是一个具有帧错误检测和地址识别硬件的增强型串行口。UART0可以工作在全双工异步方式或半双工同步方式，并且支持多处理器通信。接收数据被暂
