基于FPGA的部分重配置--补充 (2006-08-26 20:40:21)
FPGA部分重配置在实现是以FPGA的模块化设计为基础，两者最大的不同在ucf文件中。FPGA部分重配置的ucf文件要手动添加总线宏的约束和重配置模块的属性。如下：总线宏INST"u2"LOC="TBUF_R5C5.0";&nbs
发表于 7/14/2010 1:52:30 PM
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基于FPGA的部分重配置 (2006-08-21 17:56:36)
部分重配置，既动态配置部分芯片时，芯片的其他部分可正常工作，且向芯片中下载部分配置bit文件时，芯片的DONE脚不被拉低。使用FPGA的这一特性，可实现对芯片的分时复用。首先做部分重配置的FPGA内部必须要有TBUF，因为在部分可重配置中，重配置模块和其它
发表于 7/13/2010 1:46:33 PM
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FPGA开发中的模块化设计 (modular design) (2006-08-10 16:09:18)
模块化设计适用于团队开发设计内部关系易于划分、模块间连接较少的项目。模块化设计首先由teamleader进行整体设计，各模块使用blockbox代替，只指明模块间的连接（使用“伪逻辑”（pseudologic）连接）和整体设计的外部端口，并约束各模块在FPGA芯片内
发表于 7/13/2010 1:45:51 PM
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GAL
发表于 7/9/2010 2:41:10 PM
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bmp、jpeg、gif比较 (2006-06-03 10:28:48)
发表于 7/9/2010 2:40:17 PM
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P2P (2006-05-30 22:14:51)
发表于 7/9/2010 2:39:22 PM
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IIC与视频芯片7113(3) (2006-05-19 23:05:17)
IIC总线由两根双向线组成，SDA（数据）和SCL（时钟）。空闲时线上的状态是‘1’，开始传送数据时SCL保持高、SDA下降延，之后每次时钟高电平时接收数据的器件采样，连续在8个时钟高电平采得由高到低的8bit数据，之后向发送数据方发送应答。结束传送SCL保
发表于 7/8/2010 3:40:26 PM
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DDR时序(1) (2006-05-14 22:28:14)
很长一段时间在FPGA上做DDR的控制器,试着用xilinx的IPCode可是在实现时出了问题.后来决心自己写,又因为频率过高(100M),写出的控制器有毛刺,不稳定.下图是我仿真的结果:dqs是datastrobe当dqs是上升延或下降延时dq_out的输出被DDR接收,dq_t是控制双向口的信号,dq_t
发表于 7/8/2010 3:37:05 PM
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IIC与视频芯片7113(2)
IC接口中的SDA和SCL通过上拉电阻连接到电源上,芯片在IIC线上只输出0和Z,1是上拉电阻提供的,并且连接到IIC的输出级必须是漏极开路线集电极开路,这样才可以实现线与的功能.在FPGA中实现时,双向口SDA和SCL要连ISE元件库里的pullup元件,实现上拉电阻的功能.
发表于 7/7/2010 4:48:19 PM
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IIC标准与视频芯片7113(1) (2006-05-08 22:23:46)
IIC是Philips公司定义的总线规范.使用两个引脚SDA和SCL可双向传送数据,工作时总线两端的器件分为Master和Slave.用iic配置7113时,7113是Slave,Master我使用FPGA.SCL始终由Master控制.当Master向Slave写时,先由Master发出7位要寻址的Slave器件地址和1位读写标志(1是
发表于 7/7/2010 4:47:19 PM
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JPEG压缩简介（3） (2006-05-04 23:16:41)
前两篇写了JPEG图像数据的处理，这一篇写一下JPEG文件中各种信息的组织。JPEG文件中有各种命令标志文件的各种信息，各命令的开头8bit是11111111既0xff，例如图像开始是FFD8（startofimage命令），图像结束是FFD9（endofimage命令）。文件中的内容应该是：1、FFD8
发表于 7/7/2010 4:46:05 PM
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在没有浮点乘的处理器中的程序优化 (2006-04-25 20:27:23)
浮点乘可以用整数乘和右移位代替，例如124*3.072711026可以用124*25172再右移13位实现。除法与之相反。在做除法时可以先比较被除数和除数的大小，若被除数小于除数的1/2，则商是0（商是整数且计算四舍五入时）。这样在商可能是很多0的数据处理中可以大幅提高效率
发表于 7/6/2010 2:00:19 PM
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JPEG压缩简介（2） (2006-04-28 22:07:32)
5、Huffman编码DC与AC的huffman编码表是不同的两个.JPEG位提高效率，不直接存储数值，而是将数值分成16组用于存储。分组规则是，正数时表示此正数的二进制码的长度是组号，二进制表示即使存储值，负数时用来表示负数绝对值的的二进制码的长度是组号，存储值
发表于 7/6/2010 1:59:42 PM
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jpeg压缩简介（1） (2006-04-24 20:02:24)
发表于 7/5/2010 3:20:45 PM
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你会用Google？(转载) (2006-04-18 20:13:34)
发表于 7/5/2010 3:19:08 PM
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