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维护遗留代码（3）——缺少JTAG接口的遗憾
早在代码移交阶段，我就向第三方提出过电路板上缺少给FPGA预留的JTAG调试接口的问题。电路板上本来已经给CPLD预留了JTAG下载接口，把FPGA连接到已有的JTAG链路中并不是什么难事。可是由于我们看到PCB设计时电路板已经投产，并且是最终要交付用户使用的量产版，即使是这
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维护遗留代码（2）——从搭建仿真环境入手
代码移交完成后，为了尽快掌握第三方开发的FPGA代码，我面临的首要任务是搭建一个完备的仿真环境。原工程在QuartusII下采用波形文件搭建了仿真环境。用过QuartusII集成仿真工具的朋友应该了解，与Modelsim相比这个仿真工具存
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维护遗留代码（1）——从代码移交说起
2009年6月下旬，riple开始着手维护一套第三方开发的FPGA代码。在移交之前，所有的代码维护都是由第三方完成的，我们很难控制项目的时间进度，所以决定自己维护FPGA代码，以求加快项目进度。由于先前没能谈妥代码移交的问题，第三方代码对我们是不公开的，只有最终的二进
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Altera Forum精彩问答汇总
坛中一日，人间数年！Icantaffordlosinganyofthiskindofinvaluableinformationanymore!ItisnottoolateifIstartreadingandcollectingthemfromnowon.IwilllookthethreadsthrougheverydayasIdowithmyHotmailE-mailsandEETimesRSSs.ItsallaboutTiming：SunNov08200909:35:01
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《基于FPGA的快速系统原型开发》评阅人意见
国庆放假前，riple曾经跟一家出版社联系过翻译出版《基于FPGA的快速系统原型开发》一书的事，经过了一个多月的等待，得到了否定的答复。原因是该书在Amazon上的星级太低，市场前景不好。悲哀啊！要知道，Amazon上的三条评论中，只有一条公允的评论是真正看过并看懂了该
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从SignalTap II中获取“最真实”的仿真测试向量
在实际工作中，经常会遇到这样的情况：在硬件调试中采用SignalTapII反复多次编译并最终捕获到问题的原因时，才会发现，原来这个问题是逻辑问题，是可以在仿真环境下发现并快速解决的。先前没能从仿真中发现这个问题，要么是因为尚未或难以创建对应的测试向量，要么是因
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关于FPGA硬件调试的三个问题
1.Q：采用Synplify综合时，如何在SignalTapII中获得对信号的最佳的可观察性？A：我采用了一个“土”方法：在Synplify的源文件列表中把要观察的模块对应的文件删除，这样Synplify在综合时就会把该模块当作“BlackBox”，然后把生
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如何在Ubuntu 8.04下安装OVPsim
OVP（OpenVirtualPlatforms）成立于2008年3月，成立之初就推出了OVPsim这一免费的虚拟平台仿真工具，在此基础上提供的开放API和开源模型构成了一个完整的虚拟平台开发环境。直到2009年5月之前，在www.ovpworld.org网站上只提供Windows下的免费开发和仿真运行环境，Linux
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为什么偏偏是十六进制？——on the road to being a professional
我的数学一直不好！作为一名FPGA逻辑开发工程师，我的二进制数学更是学得不好。我在小学五年级时就能够用二进制加法法则推导二进制乘法结果了，但是在那以后一直就没有什么长进。我在研究生毕业时才强记住了2的各次幂的结果：2的3次方是8，2的4次方是16，2的6次方是64，
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Modelsim时序仿真中遇到的三个问题
我很少做时序仿真（记忆中针对8051的IPcore做过QuartusII下面的时序仿真，针对Samsung的一款NandFlash仿真模型做过Modelsim下的时序仿真）。一是因为仿真速度慢；二是因为仿真的对象是布局布线后的门级网表，许多信号都消失不见了。由于其受限的可观察性，针对布局后网
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如何在Ubuntu 8.04下安装verilator
曾经成功安装过verilator，虽然摸索了一段时间，但是还算顺利。今天试图重新安装，结果反复尝试了4遍，才把所有的安装测试程序跑通：一些步骤是README里没有说清的。riple把成功的安装过程记录下来，希望对大家有所帮助。sudoapt-g
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如何阅读ATA-5协议文档
ATA-5标准规范文档（下文简称ATA-5文档）是我工作以后用到的第一份比较全面而复杂的标准文档。这份文档，在我第一份工作近三年的时间内被我反复的阅读和使用。在它的指导下，我完成了一款ATA设备端产品的维护、升级和另一款新产品的开发。正如对自己的第一份工作怀有深
