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海外捉虫记—设计流程的哪些阶段需要回归测试
除了HW的仿真，在软硬件集成开始后，对于产品原型的回归测试也不应该忽略。回归测试最好自动化。仿真回归测试自动化还好说，产品回归测试的自动化就需要多花些功夫考虑了。海外捉虫记—设计流程的哪些阶段需要回归测试
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海外捉虫记—控制通路有没有静态检验方法
CPU接口涉及到大量的译码逻辑。如果能够不经过动态仿真，采用一种工具静态地验证memorymap与hdl代码之间的对应关系，软硬件联调就会快很多。进一步，如果可以由memorymap直接生成hdl代码就更好了。
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海外捉虫记—如何给线性状态机建模
线性状态机是最简单的状态机，但是对时序要求最严格，容易出现小错误。其实就是流水线。如果能够用simulink对其建模，一定可以提高开发效率。
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海外捉虫记—时序问题是怎样解决的
Kevin确实经验老到，我们两个看来需要PCB改版才能解决的问题，经他调了几天，还真证明出通过FPGA的内部时序调整，也可以找到一条通往系统时序收敛之路。1.控制引脚输出延时。采用DDIO是个很好的方法。2.采用PLL或者是clkctrl保证时钟占空比。
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海外捉虫记—向别人学习，永远不嫌自己太老
几年、十几年后，我也会成为经验丰富的工程师。到那个时候，我会不会不愿意听取比自己更年轻的工程师的建议呢？到那个时候，我在某一个领域积累了很多经验，我会不会认为自己在这一领域无所不知，从而忽视和别人的交流呢？每个人都有自己的长项和短项。要进步，必要虚心
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海外捉虫记—不会开车，寸步难行
看了太多的Friends和SexandCity，看惯了室内戏、看惯了出门就打车，忘了美国是一个车轮上的国家。在硅谷这一带，没有汽车，真是寸步难行。总求人，自己也过意不去。回国内，就开始学开车。下次再来，争取自己租辆汽车，上班、吃饭、购物、观光就都不成问题了。
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海外捉虫记—控制通路接口，还是软件多做些工作好
软件灵活得多，而且修改不会引入时序问题。对于控制通路这样的高抽象层次模块来说，软件更容易直接修改。在控制通路上，不妨给软件多留些工作。不是为了偷懒，是为了更好地适应需求和定义变更。
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编码越少，支持越多?
软硬件功能划分是现在的嵌入式系统设计中很常见也很关键的一个步骤。在MCU+FPGA的系统架构中，对配置灵活性要求高的功能用MCU来实现，对实时性有硬性要求的功能要用FPGA来实现。这样划分功能实现的嵌入式系统，其灵活性和实时性就能兼顾。这样做符合控制单元和数据通路
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Simulink HDL Coder——基于模型的FPGA设计
总有一天，FPGA设计将不再是硬件工程师的专利，最优HDL编码的规律将会嵌入到EDA工具之中，FPGA设计输入的抽象层次将会提升到系统级。SimulinkHDLCoder就是这样一款ESL工具（最初在Simulink2006b中引入），通过它，我们可以一窥FPGA设计的未来。RecordedWebinar:RapidFPG
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学习Tcl（七）——qSlave和qMaster
qSlave其实是Server，而qMaster是Client。这是QuartusII自带的简单分布式编译工具中的两个Tcl软件包：::quartus::qMaster和::quartus::qSlave。这组Tcl软件包主要在QuartusII的DSE中应用，可以通过DSE的GUI界面向多个服务器分发编译任务，并收集编译结果。通过构
