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BJ-EPM CPLD入门套件VHDL例程4
--Filename﹕LED_SEG7.vhd--Author﹕wuhouhang--Description﹕2位数码管每隔640ms从0-F循环递增显示libraryIEEE;useIEEE.std_logic_1164.all;useIEEE.std_logic_arith.all;useIEEE.std_logic_unsigned.all;entityLED_S
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dsc生成两路不同频率的pwm信号
最近老有做智能车的朋友问我，如何使用dsc生成两路不同频率的pwm信号？其实这个很简单，今天没事，用pe生成了一个简单的例子，分享给大家。程序使用的是mc56f8013数字信号控制器，pwm功能则是使用的通用定时器完成，而没有使用pwm模块。建立一个pe工程，然后添加been，
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南洋理工大学—新加坡的骄傲
南洋理工大学前身为南洋大学,1955年由东南亚民间发动筹款运动而创办。1980年,南洋大学并入新加坡国立大学。次年,南洋理工学院独立出来,开始走向独立发展之路。之所以要独立,重要原因是上世纪70年代末新加坡的经济重组。经济重组需要大学为经济的快速腾飞培
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PCB板制作原理图常见错误
（1）ERC报告管脚没有接入信号：a.创建封装时给管脚定义了I/O属性；b.创建元件或放置元件时修改了不一致的grid属性，管脚与线没有连上；c.创建元件时pin方向反向，必须非pinname端连线。（2）元件跑到图纸界外：没有在元件库图表纸中心创建元件。www.pcbdate.cn（3）创
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抑制PCB高级设计共阻抗干扰的措施
(1)一点接地使同级单元电路的几个接地点尽量集中，以避免其他回路的交流信号窜人本级，或本级中的交流信号窜到其他回路中去。适用于信号的工作频率小于1MHZ的低频电路，如果工作频率在1一1OMHz而采用一点接地时，其地线长度应不超过波长的1／20。总之，一点接地是消除地
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吉时利讲堂：2602型数字源表数模转换器测试实例
为了说明2602型数字源表在多通道、多功能测试应用中的源表能力和灵活性，让我们看一下8-位乘法数模转换器(DAC)的测试序列。图1给出这个应用的测试设置。通过TSP-Link连接的每个仪器都被分配一个唯一的节点编号，类似于GPIB地址。DAC实例使用两个节点(节点1和节点2)，每
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AD9854的非线性调频输出
DDS(直接数字频率合成)将先进的数字信号处理理论与方法引入信号合成领域，实现了合成信号的频率转换速率与频率准确度之间的统一，广泛应用于通信射频电路中。DDS的基本原理是利用来样定理，通过查表法产生波形。AD9854能够产生多种形式的输出信号，其工作模
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应用AD9852时需注意问题
在使用AD9852时，有时需要使两片AD9852实现同步，即使得2片AD9852输出信号波形相位同步。其中的关键问题是工作在相同的系统时钟下，每个AD9852的系统时钟之间的最大相位误差不能超过1个周期。AD9852的系统时钟可由参考时钟直接提供，或将参考时钟通过内部的时钟倍
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应用AD9850主函数
#include#include#include#defineucharunsignedchar#defineuintunsignedint#defineulongunsignedlongucharb,k=2,l=1;ucharkey,f=1;ulongm=1000,n=1,bj=10;ulonga,temp1;floatfreq;sbitW_CLK=P2^4;sbitFQ_UD=P2^3;sbitRST=P2^2;sbitLCD_RS=P2^7;sbitLCD_RW=P2^6;sb
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应用AD9850函数说明
/**********************************************************延时子函数**********************************************************/voiddelayms(unsignedintms){unsignedchart;while(ms--){for(t=0;t<114;t++);}}/**************************************
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无线通信中FEC 编码原理及评价（3）
大家好，前面我们给大家介绍了无线通信中FEC编码原理（1）和（2），今天继续献上FEC编码原理及评价（3），关于不同FEC种类的评价，希望对大家有所帮助～对于不同FEC的评价这里我们介绍一些典型的FEC的应用并且做出一些解释和评价。我们根据不同的使用将这一部分分
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ADI公司锁相环杂散问题
锁相环中最常见的杂散信号就是参考杂散。有用信号频率从而降低接收机的灵敏度。锁相环中参考源、R分频器、滤波器、压控振荡器、分频器等部分都会产生噪声，相应的就会引入杂散，并且通过环路的传递最终成为输出信号的一部分，但是这其中最大的两个噪声源为输入噪
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ADI公司锁相环时序及频率问题
在使用锁相环相对应的芯片时，我们应该先检测时序图，ADI的所有锁相环产品控制接口均为三线串行控制接口。但是要注意一点是：LE的上升沿应跟Clock的上升沿对齐，而非Clock的下降沿。上图是错误的，下图则是正确的。控制接口由时钟CLOCK，数据DATA，加载使能
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上传一个自己做的freemaster实现飞思卡尔mc56f8013调试的例程
上传一个自己做的freemaster实现飞思卡尔mc56f8013调试的例程1638293631310.rar
