mul8_unsigned multipliter
李亚民老师更注重硬件设计思想的训练。他给出的硬件设计方法更贴近底层硬件，下面看看他的设计思想 ...
发表于 6/20/2013 1:51:53 PM
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signed add
哎，作为一个xx貌似我只会盗用别人的code。这个还是“copy”真OO 无双大师的手笔写的 1 //date:2013/6/15 2 //designer :pengxiaoen 3 //function:signed number ad...
发表于 6/15/2013 1:46:36 PM
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serial_to_parallel
1 //date :2013/6/11 2 //designer :pengxiaoen 3 //function :serial_to_parallel 4 5 module serial_to_parallel ( 6 ...
发表于 6/12/2013 1:44:24 PM
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parallel to serial
1 // date :2013/6/11 2 //designer :pengxiaoen 3 //function :parallel to serial 4 5 module parallel_to_serial ( 6 ...
发表于 6/12/2013 1:42:25 PM
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base of logic
发表于 6/11/2013 2:32:52 PM
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用modelsim仿真——对文件的操作
Verilog也可以像C 一样对文件进行读写操作看到了真OO 无双的博文，对抄了一下代码，嘿嘿（菜鸟的鸟蛋的做法） 我自己在D盘下创建了两个TXT文件，一个是stepfile1，一个是stepfile2在stepfile1 中输入1...
发表于 5/25/2013 11:41:22 AM
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使用signalTapII看综合掉的wrie和register的值
此博文内容是欣赏完 为真OO 无双博客的笔记比如我们要看reg [3:0] 这个cnt 的值，但是如果Quartus 将它综合了呢可以将这个语句改成或者是 如果将它放到module后面这个的功能是不综合这个module中的reg/*sy...
发表于 5/24/2013 11:49:18 AM
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避免QuartusII中将没有进行定义的信号自动生成wrie类型
本博文是按照真OO无双博客中的内容编写，因为自己是 不到黄河不死心的人，所以还是自己动手试试。当然不是怀疑人家的意思，只是觉得——有意思。好奇者莫怪。 果然出现的是warning果然强大，加进去了出现了error，哈哈`default_ne...
发表于 5/24/2013 11:48:16 AM
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while执行两次的问题，已经解决
//2013 5 11//designer :pengxiaoen// function change the number 'd' to 'b'#include "stdio.h"unsigned long int in_un_numbe...
发表于 5/11/2013 11:04:05 AM
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check_negation
//date : 2013 5 6//designer:pengxiaoen//function: check the symbol ~ #include "stdio.h"int main (){ char u8_char_temp;...
发表于 5/6/2013 11:03:15 AM
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最小二乘法原理
最小二乘法原理 在我们研究两个变量(x, y)之间的相互关系时，通常可以得到一系列成对的数据(x1, y1、x2, y2... xm , ym)；将这些数据描绘在x -y直角坐标系中(如图1), 若发现这些点在一条直线附近，可以令这条直线...
发表于 4/19/2013 2:31:24 PM
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check_FunctionAddress
//date :2013 4 18 //designer: pengxiaoen//function :check the function addressint function (){int i = 10;return ;}int ma...
发表于 4/18/2013 11:02:25 AM
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check the sentence &ff
//date 2013 4 17 //designer :pengxiaoen//function : check the sentence &ff#include "stdio.h"#include "stdlib.h"int main ...
发表于 4/18/2013 10:58:28 AM
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clk_3
// date : 2013,3,18//designer : pengxiaoen// function:the T of the output_clk is three times of clk module clock_3 (...
发表于 4/5/2013 1:40:59 PM
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