采用Darlington管驱动Relay
什么场合需要Relay在一些过电流的电路中，采用coil吸附簧片的机械式relay有内阻低和耐压高的优势。这些都是IC型模拟开关不具备的。以常用omron的G6K板上relay举例，内阻 100 mΩ max，过流 1 A at 30 VD...
发表于 11/15/2016 12:58:32 PM
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Vivado中综合实现和出bit文件
接上一节的把IP搭建成原理图，这节说下综合实现和出bit文件。各Block都搭建完成后，选中这个bd右键，Generate Output Products主要是把IP参数和连接信息update到project中，同时也会检查错误。（一般sy...
发表于 11/14/2016 6:00:56 PM
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Vivado中新建工程或把IP搭建成原理图
上一节说了怎么建自己的IP，下面把自己的设计方案用IP的方式搭建成原理图。新建project选择芯片型号xc7z020clg400-1既然vivado是按照IP原理图来设计的，首先是要添加block直接从IP Catalog中选择想要的IP...
发表于 11/14/2016 5:33:05 PM
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Vivado中将verilog代码封装成IP
Xilinx的Vivado采用原理图的设计方式，比较直观适合大型项目，我们自己的code都需要封装成user IP。这里主要介绍怎么把多个关联管脚合并成类似bus的大端口第一大部分 选择source文件先新建一个project，把要pack...
发表于 11/14/2016 1:04:05 PM
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I2C转GPIO的IO扩展芯片输出电流不足-PCF8574
板子上因为IO口不够用，采用了一个I2C转8路GPIO的芯片PCF8574（tssop20），控制Darlington管MC1413，驱动后端的7个Relay。控制逻辑简图：问题：调试中发现，前面的控制逻辑都是正确的，但是Darlingto...
发表于 11/12/2016 1:54:06 PM
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