88e1512 sgmii 功能实现
近期在捣鼓88e1512 的sgmii接口。需求是将88e1512的sgmii接口与一颗交换机的sgmii接口连上，实现sgmii转copper，当然也可以用SFP接到sgmii上实现。要实现sgmii转copper，要做到以下几点。第一，...
发表于 2020/6/4 11:07:31
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支持2.5G带宽的 phy 器件调试分享（88e2110）
支持2.5G带宽的phy 市面上比较少，而且基本上只有博通、marvell生产。但是随着2.5G 网卡的出现，下行端口2.5G也随之涌现。ok，话虽饶舌，言归正传。 我用的这颗phy是Marvell的，支持2....
发表于 2020/5/18 9:40:02
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DP83867E SGMII接口调试经验
最近这段时间在调试SGMII 接口，有些经验分享下。项目背景是有一颗交换机芯片，除了内置的phy，还预留了一个支持SGMII的MAC接口。要想实现该MAC接口功能，自然得外挂一个支持SGMII 的phy芯片。使用过两种phy芯片，一个是ma...
发表于 2020/4/29 16:31:03
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cadence 原理图页码设置
最近做的项目涉及到原理图较多，几十页的原理图不可能一个个修改页码，页码数和总数设置正确会方便使用off-page功能。在网上搜，
发表于 2020/3/24 13:53:22
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分享一个MPU板卡调试案例
前段时间参考官方交换机设计方案，设计了一款交换机。这款交换机很简单，交换机功能就是一颗交换机芯片，出于特殊需求，加了一颗MPU，外挂DDR2和FLASH。在调试板卡时候，我太过于期待结果，毕竟是头次设计带有BGA封装的6层板卡。上电后发现交...
发表于 2019/12/3 13:48:59
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cadence BGA区域内走线规则约束constraint region设置
1、打开Allegro constrain manager，如下图：2、进入physical->region->all layers，画面如下：3、在该界面下，create physical constraint set，在此，我们将该cs...
发表于 2019/10/15 8:59:15
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cadence 回注
有时候在layout 之后发现 pcb上的序号凌乱，需要重新排序。这时候可以在pcb中进行重排序，然后回注到原理图中，最后从原理图导出网表，在导入到pcb中，检查上一步回注是否准确。1.pcb做完后，点击logic——Auto Rename...
发表于 2019/7/9 14:01:09
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cadence 等间距布局方法
在进行cadence布局时候，如果需要将器件等间距布局。例如一排20个电阻，要求这些电阻两两之间是50mil，并且是水平对齐。那么在placement 模式下，选择所有器件，右击选择align component，在option选项中有对齐...
发表于 2019/3/29 11:05:49
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cadence 如何复制相似布局
在cadence pcb布局时，会遇到类似的布局，如有俩网口的布局，那么在费劲做完第一个布局后，在画同样时间精力做第二个类似布局，如果真这么做了，那么只能说明我们没有好好利用cadence。
发表于 2019/3/28 16:11:48
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精度和分辨率
经常遇到精度和分辨率这俩概念，总觉得是一回事，又不是一回事。俩看起就是像雾像风又像雨。今天看到一个TI 博客，形象的对俩者做了区别。先上图。
发表于 2017/6/19 17:35:24
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差分对：你需要了解的与过孔有关的四件事（转自ＴＩ）
在一个高速印刷电路板 (PCB) 中，通孔在降低信号完整性性能方面一直饱受诟病。然而，过孔的使用是不可避免的。在标准的电路板上，元器件被放置在顶层，而差分对的走线在内层。内层的电磁辐射和对与对之间的串扰较低。必须使用过孔将电路板平面上的组件...
发表于 2017/6/16 17:17:57
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candence导入网表后missing or extra pin 错误原因
今天尴尬了，作为一名有着两年电路设计工作经验的小司机，画完原理图，检查原理功能和封装后，生成网表，正常，打开pcb editor 导入网表，WTF，竟然报错，更羞辱的这错误看的我一头雾水。话休饶舌，上图看错误。
发表于 2017/6/1 17:23:15
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spartan6 硬件设计笔记
在做spartan6 硬件电路设计的时候，设计许多方面，譬如电源选择，模式配置，总之感觉需要关注很多零零散散的点，最近整理一些阅读记录，方便后期查看。1.
发表于 2017/5/31 16:13:18
阅读（1589）
