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特权同学AT7 Xilinx USB3.0+LVDS+ FPGA开发板介绍
板子配套的所有资料（文档、例程、Vivado软件），已经更新的最新的资料都会放置在百度公共网盘中供免费下载：http://pan.baidu.com/s/1kUKzt5P 板子配套的所有资料（文档、例程、Vivado软件），已经更...
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【转】DDR3中的Write_leveling
1）为了更好的提高信号完整性，DDR3存储模块采用了fly-by的拓扑结构。该拓扑应用于地址、控制、时钟线。Fly-by拓扑能有效减少stub的长度，但是较长的走线带来了CK-CK#与DQS-DQS#间的时延（由于CK-CK#的飞行时间，其...
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Altium Designer BGA扇出
AD BGA扇出和原理图中PCB的类和布线规则设置第一，Altium Designer 认识了这么久，没有用过他的自动扇出功能，今天一试，效果还算不错，不过现在还没有找到不扇出没有网络的引脚的方法，我现在讲我的自动扇出步骤给大家说一下，在B...
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BGA 256 FPGA PCB设计
终于耐不住寂寞，开始了PCB设计。。为了降低成本，拟采用4层板搞定256 IO的FPGA，同时使用所有的IO，绝不浪费任何一丝的资源。。。。大多数业内人士说，256IO 4层全部走线，可能性不大。。。不好意思，我好想实现了。。。且不说我La...
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压敏电阻器的结构原理及参数 （tvs,气体管，防雷击）
压敏电阻器是一种以氧化锌为主要成分的金属氧化物的半导体非线性陶瓷元件，按其伏安特性可分为对称型(无极性)和非对称型(有极性)两种。它具有：电压范围宽、通流容量大、非线性系数较大、漏电流小、伏安特性对称、响应时间小、残压低。动作快和无续流、工...
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聊一聊DDR3中的ODT
ODT（On-Die Termination），是从DDR2 SDRAM时代开始新增的功能。其允许用户通过读写MR1寄存器，来控制DDR3 SDRAM中内部的终端电阻的连接或者断开。在DDR3 SDRAM中，ODT功能主要应用于：
·DQ, DQS, DQS# and DM for x4 configuration
·DQ, DQS, DQS#, DM, TDQS and TDQS# for X
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FPGA引脚（接上文）
20/26. nCONFIG 专用的输入管脚。这个管脚是一个配置控制输入脚。如果这个脚在用户模式下被置低，FPGA就会丢失掉它的配置数据，并进入一个复位状态，并将所有的I/O 脚置成三态的。nCONFIG从低电平跳变到高电平的过程会初始化重...
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DDR3 SDRAM Package Pinout Description
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学习朱有鹏嵌入式Linux课程的感受
学嵌入式的人应该知道，未来是物联网+人工智能的时代，嵌入式必将发挥很大的作用。我也不记得是从哪儿了解到的，在这里我想写下一些自己的感受在那之后，我就开始有意识的记住了嵌入式，通过我的学习跟了解，发现我越来越对嵌入式充满了兴趣。我是怎么知道朱...
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《微机原理》的课程改革与电子类专业的转型求生之二——何为CE？
前几天不断有一些大三已经结束准备升大四的同学过来找我，原本以为他们是想找我聊聊保送研究生的事呢。毕竟现在终于正式升了副教授了，有正式的招生资格了（虽然已经指导了多届研究生，大多数都有不错的前途，之前也有所介绍）。结果这些同学却都是来找我咨询...
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FPGA的激光测距系统研究设计
本文的研究内容是在激光测距项目基础上进行的，分析了各种激光测距方法的
利弊，最终选用脉冲激光测距的实现方式。本文设计了以 FPGA 为核心的信号处理
模块，实现了对激光信号的编码和译码、对激光发射控制时钟的分频、和内部 PLL
倍频，实现内部高频计时时钟等，提高了系统的精度和稳定性。使用并行脉冲计数
法，提高了计时精度，分析了可能产生误差的原因。
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你不知道的plc编程还可以这样
现在像工业自动化、物联网、互联网+，人工智能这些概念非常火热，尤其是人工智能，最近总是有不少的报道称，多少年以后，机器人又会代替多少的岗位。那么对于从事与自动化或者与电气相关关的你，又该何去何从。退出这个行业？显然是不现实的...
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cyclone V GT设计要点
CYCLONE V是2012一批产品了。我当时记得只用了普通逻辑设计。没有带收发器的功能设计。现在带了收发器，所以有必要总结下设计要点。 1. cycloneV的 内核电压是1.1v，收发器也是1.1v，这个需要主要有个上电时序要求。...
