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就等你来!专栏作家招募令

尊敬的AET网站会员: 电子技术应用网决定于2022年6月起招募专栏作家。
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三十而立学FPGA之数码管

简介数码管,一种把多个发光二极管通过简单阵列的方式组合而成的显示器件。多个二极管阴极连在一起,通过控制阳极的高低电平来控制数码管相应LED亮灭的叫做共阴,反之共阳。每个发光二极管称之为数码管的段,连在一起的阴极或阳极称之为位。实现框图 模...
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十而立学FPGA之UART

三十而立学FPGA之UARTUART介绍简介 通用异步收发器(Universal Asynchronous Receiver/Transmitter),既UART时序 根据时序图可以了解到:1. uart在空闲的时候是高电平2. 当突变为...
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PM-IQ光调制器自动偏置点控制模块

青岛芯诚光电科技有限公司是一家新型通信系统算法及硬件解决方案商,从事通信物理层调制解调算法的FPGA实现,DSP算法IP核销售,硬件电路研制、生产、销售,上位机控制软件、人机交互、显示界面开发,基于计算机集群及GPU的算法设计等。公司致力于星地微波射频通信、相干/自相干光通信物理层算法研究及基于FPGA的算法研制等工作,助力高校和科院所相关科研项目的系统设计、核心算法研制及落地工作。
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基于40Gbps速率DQPSK调制光自相干探测技术的空间激光通信接收机

青岛芯诚光电科技有限公司是一家新型通信系统算法及硬件解决方案商,从事通信物理层调制解调算法的FPGA实现,DSP算法IP核销售,硬件电路研制、生产、销售,上位机控制软件、人机交互、显示界面开发,基于计算机集群及GPU的算法设计等。公司致力于星地微波射频通信、相干/自相干光通信物理层算法研究及基于FPGA的算法研制等工作,助力高校和科院所相关科研项目的系统设计、核心算法研制及落地工作。
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Zynq-7010/7020/7000/7045/7035低成本高性能ARM+FPGA方案

Xilinx Zynq-7000系列XC7Z010/XC7Z020高性能低功耗处理器设计的异构多核SoC工业级核心板,处理器集成PS端双核ARM Cortex-A9 + PL端Artix-7架构28nm可编程逻辑资源,
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缺芯!涨价!i.MX 6ULL用户“慌”了?看这里!

缺芯!涨价!交期52周!从2020年底开始到现在,相信听到的、看到的最多的都是这几个关键词了,这引发了不只是消费类市场的恐慌,也引发了工业类市场的恐慌。众所周知,相对比消费类市场,工业类市场的产品更加稳定、更新换代速度较慢、生命周期更长。但...
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Linux的系统启动卡制作及系统固化

本指导文档适用开发环境:Windows开发环境:Windows 7 64bit、Windows 10 64bitLinux开发环境:Ubuntu 14.04.3 64bit虚拟机:VMware14.1.1U-Boot:U-Boot-2020...
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「方案分享」基于C6678+Zynq-7045 目标追踪视觉技术

随着现代科技的高速发展,机器视觉技术在无人机、安防监控、工业检测、ADAS高级驾驶辅助系统、医疗诊断等方面有着广泛的应用。目标追踪的视觉技术是计算机视觉领域的一个重要分支课题,有着重要的研究意义。1、方案要点(1) 图像数据采集通过可编程逻...
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Fatal: (vsim-3381) obsolete library format for design unit. 解决办法

有很多软件仿真都是blackboxs黑盒子模式,所以用modelsim提示该错误。错误的原因是在于库用了其他旧的软件版本编译好的。所以解决的办法如下:在已经映射好的库选择refresh就可以刷新库,完成重新生成库文件。或者用下面的指令。强制刷新。vlog-workD:/programmer/latti
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INTEL USB-BLASTERII使用说明-回读和写入

PL-USB2-BLASTER就是altera的USBBLATERII烧录器。通过USB2.0接口,转换成JTAG以及AS相关的数据。注意接口是JTAG和AS一起的。在左边是JTAG模式,右
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用fpga实现1G Eth TCP&UDP硬件协议栈

用fpga实现的1G以太网硬件协议栈,属于轻的协议栈
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Lattice CrossLink-NX/Certus-NX FPGA 对PCIe的支持

本文主要介绍Lattice近期发布的两款芯片对PCIe协议的支持,以及相关IP的使用方法和注意事项。
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特权同学2020视频教程《Verilog边码边学(FPGA工具与语法篇)》

Verilog的学习没有什么捷径,什么“速成班”都是假的,Gladwell前辈的1万小时定律才是真的,没有大量时间和精力堆砌的空中楼阁迟早是要破灭的。因此,特权同学带着过去10余年1万小时的积累和总结,希望能带着大家一步一个脚印,脚踏实地的在Vivado和Modelsim两个主流的工具中完成Verilog的设计和验证。
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FPGA开发板为什么要使用SDRAM

SDRAM有一个同步接口,在响应控制输入前会等待一个时钟信号,这样就能和计算机的系统总线 同步。时钟被用来驱动一个有限状态机,对进入的指令进行管线(Pipeline)操作。这使得SDRAM与没有同步接口的异步DRAM相比,可以有一个更复杂的...