最新博文

0
推荐
147
阅读

xilinx vivado 烧录microblaze

xilinx官方告知microblaze启动是 直接用 vivado 的associate elf 选择elf文件,但是如果你的工程文件要求在ddr中运行,你就傻了。毕竟可怜的bram,是支持不了多少功能。尤其是函数大神,一个工程连...
0
推荐
210
阅读

vivado中的propagated clock

P: Propagated G: Generated V: Virtual I: Inverted...
0
推荐
479
阅读

基于 FPAG xilinx vivado 仿真模式介绍

基于 FPAG xilinx vivado 仿真模式介绍
0
推荐
829
阅读

基于FPGA vivado 17.2 的数字钟设计

基于FPGA vivado 17.2 的数字钟设计
0
推荐
455
阅读

Vivado 开发环境简介及设计流程

Vivado 开发环境简介及设计流程
0
推荐
759
阅读

Vivadoz中block memory Generator的使用方法

关于单端口RAM的使用笔记
0
推荐
903
阅读

Vivado中IP的使用方法

Vivado中IP的使用方法。
1
推荐
545
阅读

Vivado外部时钟输入问题

在使用basys3进行摄像头配置的时候出现了如下问题,最后经上网查阅资料最后得以解决,出现这个问题的原因是,遇到上面的问题是因为我们将外部输入的一个时钟管脚 OV7670_PCLK(摄像头输出给FPGA的像素时钟)分配到了一个普通的...
0
推荐
507
阅读

Vivado中各个目标(object)的含义与区别

在Vivado中ports、pins、cells的区别。
0
推荐
578
阅读

Vivado入门与提高学习记录 第一讲

Vivado设计流程及使用模式
0
推荐
750
阅读

vivado使用modelsim仿真细节考虑

至于modelsim路径设置大家都是知道的。关键compiled library localtion设定路径问题。我开始一直以为是仿真的临时目录,后来才知道是xilinx预先编译的仿真库文件所在位置。所以必须先执行仿真库预编译方式。
0
推荐
827
阅读

奔跑吧,ZYNQ-7000

基于ZYNQ-7000的开源项目
0
推荐
571
阅读

利用赛灵思Vivado HLS实现浮点设计

大多数设计人员在设计中使用定点算术逻辑来运算数学函数,因为这种方法速度快,占用面积小。不过在许多情况下,使用浮点数值格式进行数学计算更为有利。虽然定点格式可以实现精确的结果,但给定的格式动态范围非常有限,故设计人员必须进行深度分析,判断贯穿...
0
推荐
512
阅读

Vivado环境下如何在IP Integrator中正确使用HLS IP

使用VIVADO对7系列FPGA的高效设计心得[导读] 随着xilinx公司进入20nm工艺,以堆叠的方式在可编程领域一路高歌猛进,与其配套的EDA工具——新一代高端FPGA设计软件VIVADO也备受关注和饱受争议。关键词:Vivado赛灵...
1
推荐
8343
阅读

关于安装vivado2017版本,安装vc++ 2015运行库失败

最近用服务器安装windows7 64位操作系统,然后又安装vivado软件。结果vivado安装到最后的时候,弹出vc++2015 运行库不正常。 弹出的信息是设置失败,0x800b010a,无法建立到信任根颁发机构的证书链...