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利用TCL脚本(do文件)管理仿真流程简明教程(一)ActiveHDL RTL仿真篇

如本篇博文的标题所示,今天要聊的是高级一点的内容:利用TCL脚本(do文件)管理ActiveHDL RTL仿真流程。标题中的(一)表示,后续可能还会继续发布关于ActiveHDL 另外两种仿真流程的TCL脚本控制方法以及Modelsim软件的相关内容。

1.9、Diamond文件类型介绍

Diamond文件类型介绍

Lattice Diamond软件 生成黑匣子文件的方法

Lattice生成黑匣子文件的方法

1.5、Diamond中调用ActiveHDL仿真教程

1、新建my_testbench.v文件,并输入如下内容;2、Tools->SimulationWizad;3、

1.4、Diamond中,设置第三方文本编辑器(如notepad++)教程

Diamond中自带的源码编辑器并不是特别好用,我们可以自己设置自己习惯使用的第三方文本编辑器作为Diamond默认的源码编辑器。具体的步骤如下:1、

1.3、Diamond中的IPexpress入门教程

IPexpress是Lattice官方提供,集成与Diamond中的一些IP核,可以通过简单的配置以生成VerilogHDL或者VHDL的代码,以供用户实例化(调用)。一些芯片中的功能推荐使用(甚至只能使用)IPexpress来生成代码,比...

1.2、Diamond新建工程、综合、下载教程

1.2、Diamond新建工程、综合、下载教程;

1.1、Diamond的安装与激活教程

Diamond安装激活教程

Lattice系列FPGA开发相关博文(目录篇)

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