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cadence indago征程（六） eswd工具配置与仿真
上一文介绍了eswd工具的使用，该工具，可以将cpu的执行流，与elf程序对应起来，让我们方便的去debug。下面，就说一下，怎么实现上述过程。需要三个文件cpu架构描述文件cpu执行的指令流文件，下文简称tarmac文件eswd配置文件一、cpu架构的描述eswd工具，需要cpu架构的描
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ARM DynamlQ架构的power介绍
ARM的处理器，在power架构，根据cluster的架构的变化而发生了变化。一、big-little的power架构如下图，是big-little的power架构，整个cluster的所有组件，均使用相同的电压域。用虚线框包围的区域，表示该模块，有单独的powerdomain。二、DynamlQ的power架构arm在推出Dy
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ARM external debug寄存器的访问
在ARM处理器的内部，实现了若干的externaldebug（以下简称ED）寄存器，用来实现处理器的externaldebug功能。一、ED寄存器访问的条件对于ED寄存器的访问，是有条件限制的，一般是如下的几个条件。OFF:core状态是powerdown还是powerupDLK：doublelock状态是lock还是unlock
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玩转Zynq连载1——Zynq的linux启动过程
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Xilinx Artix-7 FPGA快速入门、技巧与实例连载8——FPGA进阶之路
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cadence indago征程（五）最强cpu debug工具-eswd
我们在编写c程序，在调试的时候，希望能够使用visualstudio工具，或者eclipse工具，实现单步调试，让我们能够查看c程序的执行状态，从而帮助我们去调试我们写的c程序。那在soc验证或cpucore验证（以下简称core验证）的时候。我们也是写了c程序（或者汇编程序，以下不区
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cadence indago征程（四）仿真加速indago database
indago工具很强大，对于debug环境，非常好用。但是因为仿真过程中，会产生indagodatabase，而database，会记录仿真的所有状态，因此必然就会造成仿真速度慢。如果环境非常复杂，那么仿真速度会奇慢无比。因此，就需要一些手段，来限制indagodatabase的生成，不能记录仿
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cadence indago征程（三）indago工具的使用
启动indago工具之后，indago的界面，如下图所示：下面，就介绍一些，indago的炫酷技能。一、smartlogsmartlog，显示log，并且可以将打印的一行log，和仿真状态进行关联。在每行log的开头，有一个向前或者向后的按钮，点击，表示，将仿真状态，定义到这一时刻，此时，代
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cadence indago征程（二）如何产生indago database
首先介绍下indago工具，也就是debuganalyzerapp。在debuguvm验证环境时，我们一般是通过增加打印，然后仿真，根据仿真打印的log，来确定问题。如果打印加得不够，还得修改源代码，增加代码代码。有了indago工具之后，就再也不需要在环境中，增加额外的打印代码。因为ind
