Felix

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8B / 10B Encode/Decode详解

8B/10B,也叫做8比特/10比特或8b10b。8b/10b方式最初由IBM公司于1983年发明并应用于ESCON(200M互连系统),由Al Widmer和Peter Franaszek在IBM的刊物“研究与开发”上描述。

一个关于Diamond中的Reveal如何选用参考时钟的问题

最近在调试DDR3的时候遇到一个奇怪的问题,经过一段时间的排查定位,最后发现是Reveal引起的,下面来简单地总结一下。

【转】SerDes扫盲

FPGA发展到今天,SerDes(Serializer-Deserializer)基本上是标配了。从PCI到PCI Express, 从ATA到SATA,从并行ADC接口到JESD204, 从RIO到Serial RIO,…等等,都是在借助SerDes来提高性能。SerDes是非常复杂的数模混合设计,用户手册的内容只是描述了森林里面的一棵小树,并不能够解释SerDes是怎么工作的。SerDes怎么

一种Low Latency的整数除法器设计

之前写过两篇关于除法器的文章了(http://blog.chinaaet.com/justlxy/p/5100052322和http://blog.chinaaet.com/justlxy/p/5100052068),今天来介绍一种全新的设计思想,这种设计的优势是可以用较少的资源同时实现高速度、低Latency的要求。与此同时,其缺点也很明显,只适用于除数位宽比较低的情况(比如1~8bits)。

EVDK DDR3 Demo调试笔记(关于VREF的问题)

昨天在调试Lattice EVDK开发板上的DDR3 Demo时,遇到一个莫名其妙的问题,今天来总结一下,并与大家分享。一、问题描述在Demo的顶层文件ddr3_test_top.v中有如下几句话: input test1;outpu...

【转】PRBS(Pseudo Random Binary Sequence)介绍

PRBS是Pseudo Random Binary Sequence的缩写,即“伪随机二进制序列”的意思。PRBS码具有“随机”特性,是因为在PRBS码流中,二进制数“0”和“1”是随机出现的,但是它又和真正意义上的随机码不同,这种“随机”...

Diamond使用Clarity生成的IP插入Reveal后无法综合的解决方案

问题描述: 某个工程里面使用了Clarity生成的IP,并直接将Clarity生成的sbx文件导入到工程中。在未使用Reveal功能之前,一切正常。但是当插入Reveal功能时,发现此时使用Synplify Pro综合和报错,说IP的某个文件重复了(而实际上并没有重复),因此综合失败。因为这些文件是必须的,所以解决方式肯定不是删除这些文件。

Diamond无法完成PAR的解决方案

当RTL逻辑较为复杂时,尤其是使用了多个EBR和MULT时,采用Diamond默认的Strategy时,有的时候会无法成功的PAR(P and R, Place and Route),或者PAR的速度特别慢。这个时候,我们可以尝试修改Strategy来解决这一问题。

DVI和HDMI中的TMDS接口协议

TMDS,即过渡调制差分信号,也被称为最小化传输差分信号,是指通过异或及异或非等逻辑算法将原始信号数据转换成10位,前8为数据由原始信号经运算后获得,第9位指示运算的方式,第10位用来对应直流平衡(DC-balanced,就是指在编码过程中...

ECP5 MSPI模式配置Flash出错的解决方法

今天在调试ECP5时,出现一个奇怪的现象,就是无法下载新的配置文件到Flash中了!!!

RGB颜色表

以RGB888为例:

图像插值理论研究——双三次插值(双立方插值)

双三次插值,英文是Bicubic interpolation。双三次插值是一种更加复杂的插值方式,它能创造出比双线性插值更平滑的图像边缘。双三次插值方法通常运用在一部分图像处理软件、打印机驱动程序和数码相机中,对原图像或原图像的某些区域进行...

图像插值算法研究——算法效果比较(Matlab验证)

之前写过两篇博文,介绍了最近邻插值,双线性插值和9点插值算法的基本理论,今天用Matlab来验证,并简单对比一下效果。之前的博文地址为:

推荐两个国外的FPGA学习资源网站

第一个是大名鼎鼎的OpenCore,第二个是Jean P. Nicolle的个人分享网站fpga4fun。下面分别简单介绍一下:

推荐几份Verilog的进阶学习资料

如本文标题所示,这些资料并不适合初学者,而是是否有一定基础的学习者,想进一步提高巩固的。资料来自Sunburst Design(一家知名的Verilog&System Verilog(UVM)培训团队),作者为VSG(Verilog Sta...